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    56F8366_07 参数 Datasheet PDF下载

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    型号： 56F8366_07
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    内容描述： 16位数字信号控制器 [16-bit Digital Signal Controllers]
    分类和应用： 控制器
    文件页数/大小： 184 页 / 2511 K
    品牌： FREESCALE [ FREESCALE SEMICONDUCTOR, INC ]
     浏览型号56F8366_07的Datasheet PDF文件第1页浏览型号56F8366_07的Datasheet PDF文件第2页浏览型号56F8366_07的Datasheet PDF文件第3页浏览型号56F8366_07的Datasheet PDF文件第5页浏览型号56F8366_07的Datasheet PDF文件第6页浏览型号56F8366_07的Datasheet PDF文件第7页浏览型号56F8366_07的Datasheet PDF文件第8页浏览型号56F8366_07的Datasheet PDF文件第9页  
    Table of Contents
    Part 1: Overview . . . . . . . . . . . . . . . . . . . . . . . 5
    1.1.
    1.2.
    1.3.
    1.4.
    1.5.
    1.6.
    56F8366/56F8166 Features . . . . . . . . . . . . . 5
    Device Description . . . . . . . . . . . . . . . . . . . . 7
    Award-Winning Development Environment. . 9
    Architecture Block Diagram . . . . . . . . . . . . 10
    Product Documentation . . . . . . . . . . . . . . . 14
    Data Sheet Conventions . . . . . . . . . . . . . . . 14
    Part 8: General Purpose Input/Output
    (GPIO) . . . . . . . . . . . . . . . . . . . . . . . 137
    8.1. Introduction . . . . . . . . . . . . . . . . . . . . . . . . 137
    8.2. Memory Maps . . . . . . . . . . . . . . . . . . . . . . 137
    8.3. Configuration . . . . . . . . . . . . . . . . . . . . . . . 137
    Part 9: Joint Test Action Group (JTAG) . . 142
    9.1. JTAG Information . . . . . . . . . . . . . . . . . . . . 142
    Part 2: Signal/Connection Descriptions . . 15
    2.1. Introduction . . . . . . . . . . . . . . . . . . . . . . . . . 15
    2.2. Signal Pins . . . . . . . . . . . . . . . . . . . . . . . . . 18
    Part 10: Specifications . . . . . . . . . . . . . . . 143
    10.1. General Characteristics . . . . . . . . . . . . . . 143
    10.2. DC Electrical Characteristics. . . . . . . . . . 147
    10.3. AC Electrical Characteristics . . . . . . . . . . 151
    10.4. Flash Memory Characteristics. . . . . . . . . 151
    10.5. External Clock Operation Timing . . . . . . . 152
    10.6. Phase Locked Loop Timing . . . . . . . . . . . 152
    10.7. Crystal Oscillator Timing . . . . . . . . . . . . . 153
    10.8. External Memory Interface Timing . . . . . . 153
    10.9. Reset, Stop, Wait, Mode Select, and
    Interrupt Timing . . . . . . . . . . . . . 156
    10.10. Serial Peripheral Interface
    (SPI) Timing . . . . . . . . . . . . . . . . . 158
    10.11. Quad Timer Timing . . . . . . . . . . . . . . . . 161
    10.12. Quadrature Decoder Timing . . . . . . . . . 162
    10.13. Serial Communication Interface
    (SCI) Timing . . . . . . . . . . . . . . . . 163
    10.14. Controller Area Network (CAN) Timing . 163
    10.15. JTAG Timing . . . . . . . . . . . . . . . . . . . . . 164
    10.16. Analog-to-Digital Converter
    (ADC) Parameters . . . . . . . . . . . 165
    10.17. Equivalent Circuit for ADC Inputs . . . . . 168
    10.18. Power Consumption . . . . . . . . . . . . . . . 168
    Part 3: On-Chip Clock Synthesis (OCCS) . 38
    3.1. Introduction . . . . . . . . . . . . . . . . . . . . . . . . . 38
    3.2. External Clock Operation . . . . . . . . . . . . . . 38
    3.3. Registers . . . . . . . . . . . . . . . . . . . . . . . . . . . 40
    Part 4: Memory Map. . . . . . . . . . . . . . . . . . . 40
    4.1.
    4.2.
    4.3.
    4.4.
    4.5.
    4.6.
    4.7.
    4.8.
    Introduction . . . . . . . . . . . . . . . . . . . . . . . . .
    Program Map. . . . . . . . . . . . . . . . . . . . . . . .
    Interrupt Vector Table . . . . . . . . . . . . . . . . .
    Data Map . . . . . . . . . . . . . . . . . . . . . . . . . .
    Flash Memory Map . . . . . . . . . . . . . . . . . . .
    EOnCE Memory Map . . . . . . . . . . . . . . . . .
    Peripheral Memory Mapped Registers . . . .
    Factory Programmed Memor. . . . . . . . . . . .
    40
    41
    44
    47
    47
    49
    50
    82
    Part 5: Interrupt Controller (ITCN) . . . . . . . . 83
    5.1.
    5.2.
    5.3.
    5.4.
    5.5.
    5.6.
    5.7.
    Introduction . . . . . . . . . . . . . . . . . . . . . . . . . 83
    Features . . . . . . . . . . . . . . . . . . . . . . . . . . . 83
    Functional Description . . . . . . . . . . . . . . . . . 83
    Block Diagram . . . . . . . . . . . . . . . . . . . . . . . 85
    Operating Modes . . . . . . . . . . . . . . . . . . . . . 85
    Register Descriptions . . . . . . . . . . . . . . . . . 86
    Resets . . . . . . . . . . . . . . . . . . . . . . . . . . . 114
    Part 11: Packaging . . . . . . . . . . . . . . . . . . . 170
    11.1. 56F8366 Package and Pin-Out
    Information . . . . . . . . . . . . . . . . . . 170
    11.2. 56F8166 Package and Pin-Out
    Information . . . . . . . . . . . . . . . . . 173
    Part 6: System Integration Module (SIM) . 114
    6.1.
    6.2.
    6.3.
    6.4.
    6.5.
    6.6.
    6.7.
    6.8.
    6.9.
    Overview . . . . . . . . . . . . . . . . . . . . . . . . . .
    Features . . . . . . . . . . . . . . . . . . . . . . . . . .
    Operating Modes . . . . . . . . . . . . . . . . . . .
    Operating Mode Register . . . . . . . . . . . . .
    Register Descriptions . . . . . . . . . . . . . . . .
    Clock Generation Overview . . . . . . . . . . .
    Power-Down Modes Overview . . . . . . . . .
    Stop and Wait Mode Disable Function . . .
    Resets . . . . . . . . . . . . . . . . . . . . . . . . . . .
    114
    115
    115
    116
    117
    132
    132
    133
    133
    Part 12: Design Considerations . . . . . . . . 177
    12.1. Thermal Design Considerations . . . . . . . . 177
    12.2. Electrical Design Considerations . . . . . . . 178
    12.3. Power Distribution and I/O Ring
    Implementation . . . . . . . . . . . . . . 179
    Part 13: Ordering Information . . . . . . . . . 180
    Part 7: Security Features . . . . . . . . . . . . . . 134
    7.1. Operation with Security Enabled . . . . . . . 134
    7.2. Flash Access Blocking Mechanisms . . . . . 134
    56F8366 Technical Data, Rev. 6
    4
    Freescale Semiconductor
    Preliminary

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