EP3C16Q240C8N 参数 Datasheet PDF下载

型号：	EP3C16Q240C8N
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内容描述：	[Field Programmable Gate Array, 15408 CLBs, 472.5MHz, 15408-Cell, CMOS, PQFP240, 34.60 X 34.60 MM, 4.10 MM HEIGHT, 0.50 MM PITCH, PLASTIC, LEAD FREE, QFP-240]
分类和应用：	时钟栅可编程逻辑
文件页数/大小：	34 页 / 836 K
品牌：	INTEL [ INTEL ]

Chapter 1: Cyclone III Device Datasheet

1–19

Switching Characteristics

Table 1–27. Cyclone III Devices Emulated RSDS_E_1R Transmitter Timing Specifications ⁽¹⁾(Part 2 of 2)

C7, I7

C8, A7

Symbol

Modes

Unit

Min

100

Typ

—

Max

170

Min

100

Typ

—

Max

170

Min

100

Typ

—

Max

170

×10

×8

×7

×4

×2

×1

—

Mbps

Device

operation in

Mbps

t_DUTY

TCCS

—

200

—

200

—

200

Output jitter

(peak to

peak)

—

500

—

500

—

550

—

20 – 80%,

t_RISE

500

_LOAD= 5 pF

20 – 80%,

t_FALL

—

500

—

500

—

500

—

_LOAD= 5 pF

—

(2)

t_LOCK

Notes to Table 1–27:

(1) Emulated RSDS_E_1R transmitter is supported at the output pin of all I/O banks.

(2) t_LOCKis the time required for the PLL to lock from the end of device configuration.

Table 1–28. Cyclone III Devices Mini-LVDS Transmitter Timing Specifications ^{(1), (2)}(Part 1 of 2)

C7, I7

C8, A7

Symbol

Modes

Unit

Min

Typ

—

Max

200

400

Min

Typ

—

Max

155.5

311

Min

Typ

—

Max

155.5

311

×10

×8

×7

×4

×2

×1

×10

×8

×7

×4

×2

×1

—

MHz

Mbps

_HSCLK(input

clock

frequency)

100

—

100

—

311

100

—

311

Device

operation in

Mbps

311

t_DUTY

TCCS

200

July 2012 Altera Corporation

Cyclone III Device Handbook

Volume 2

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