ADVANCE
4 MEG x 8, 4 MEG x 9, 2 MEG x 18, 1 MEG x 36
1.8V VDD, HSTL, QDRIIb2 SRAM
1 MEG x 36 BALL ASSIGNMENT (TOP VIEW)
165-BALL FBGA
1
2
3
4
5
6
7
8
9
10
11
VSS/SA1
Q18
NC/SA2
D18
BW2#3
BW1#4
VSS/SA5
Q17
CQ#
Q27
D27
D28
Q29
Q30
D30
DLL#
D31
Q32
Q33
D33
D34
Q35
TDO
W#
K#
R#
SA
CQ
A
B
C
D
E
BW3#6
SA
BW0#7
SA
SA
VSS
K
SA
VSS
D17
D16
Q16
Q15
D14
Q13
VDDQ
D12
Q12
D11
D10
Q10
Q9
Q8
D8
D7
Q6
Q5
D5
ZQ
D4
Q3
Q2
D2
D1
Q0
TDI
Q28
D20
D29
Q21
D22
VREF
Q31
D32
Q24
Q34
D26
D35
TCK
D19
Q19
Q20
D21
Q22
VDDQ
D23
Q23
D24
D25
Q25
Q26
SA
SA
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
SA
C
Q7
D15
D6
VSS
VSS
VSS
VDD
VDD
VDD
VDD
VDD
VSS
VSS
SA
VSS
VSS
VDD
VDD
VDD
VDD
VDD
VSS
VSS
SA
VSS
VDDQ
VDDQ
VDDQ
VDDQ
VDDQ
VDDQ
VDDQ
VSS
VDDQ
VDDQ
VDDQ
VDDQ
VDDQ
VDDQ
VDDQ
VSS
Q14
D13
VREF
Q4
F
G
H
J
D3
K
L
Q11
Q1
M
N
P
VSS
VSS
D9
SA
SA
SA
SA
D0
SA
SA
C#
SA
SA
SA
TMS
R
NOTE:
1. Expansion address: 2A for 288Mb
2. Expansion address: 3A for 72Mb
3. BW2# controls writes to D18:D26
4. BW1# controls writes to D9:D17
5. Expansion address: 10A for 144Mb
6. BW3# controls writes to D27:D35
7. BW0# controls writes to D0:D8
36Mb: 1.8V VDD, HSTL, QDRIIb2 SRAM
MT54W2MH18B_A.fm - Rev 9/02
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8
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