ADVANCE
4 MEG x 8, 4 MEG x 9, 2 MEG x 18, 1 MEG x 36
1.8V VDD, HSTL, QDRIIb2 SRAM
2 MEG x 18 BALL ASSIGNMENT (TOP VIEW)
165-BALL FBGA
1
2
3
4
5
6
7
8
9
10
11
VSS/SA1
Q9
BW1#2
NC
NC/SA3
VSS/SA4
NC
CQ#
NC
SA
W#
K#
R#
SA
CQ
A
B
C
D
E
BW0#5
SA
D9
D10
Q10
Q11
D12
Q13
VDDQ
D14
Q14
D15
D16
Q16
Q17
SA
SA
VSS
K
SA
VSS
NC
NC
NC
NC
NC
NC
VDDQ
NC
NC
NC
NC
NC
NC
SA
Q8
D8
D7
Q6
Q5
D5
ZQ
D4
Q3
Q2
D2
D1
Q0
TDI
NC
NC
D11
NC
SA
VSS
VSS
VDD
VDD
VDD
VDD
VDD
VSS
VSS
SA
SA
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
SA
C
Q7
NC
D6
NC
VSS
VSS
VSS
VDD
VDD
VDD
VDD
VDD
VSS
VSS
SA
VSS
NC
VDDQ
VDDQ
VDDQ
VDDQ
VDDQ
VDDQ
VDDQ
VSS
VDDQ
VDDQ
VDDQ
VDDQ
VDDQ
VDDQ
VDDQ
VSS
NC
Q12
D13
VREF
NC
NC
NC
VREF
Q4
D3
F
NC
G
H
J
DLL#
NC
NC
NC
K
L
NC
Q15
NC
NC
Q1
NC
D0
NC
M
N
P
NC
D17
NC
VSS
VSS
NC
SA
SA
SA
SA
TDO
TCK
SA
SA
C#
SA
SA
TMS
R
NOTE:
1. Expansion address: 2A for 144Mb
2. BW1# controls writes to D9:D17
3. Expansion address: 7A for 288Mb
4. Expansion address: 10A for 72Mb
5. BW0# controls writes to D0:D8
36Mb: 1.8V VDD, HSTL, QDRIIb2 SRAM
MT54W2MH18B_A.fm - Rev 9/02
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