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    10M08SCU169I7G 参数 Datasheet PDF下载

    10M08SCU169I7G图片预览
    型号： 10M08SCU169I7G
    PDF下载： 下载PDF文件 查看货源
    内容描述： [Field Programmable Gate Array, 8000-Cell, CMOS, PBGA169, 11 X 11 MM, 0.80 MM PITCH, ROHS COMPLIANT, UBGA-169]
    分类和应用： 栅可编程逻辑
    文件页数/大小： 68 页 / 976 K
    品牌： INTEL [ INTEL ]
     浏览型号10M08SCU169I7G的Datasheet PDF文件第48页浏览型号10M08SCU169I7G的Datasheet PDF文件第49页浏览型号10M08SCU169I7G的Datasheet PDF文件第50页浏览型号10M08SCU169I7G的Datasheet PDF文件第51页浏览型号10M08SCU169I7G的Datasheet PDF文件第53页浏览型号10M08SCU169I7G的Datasheet PDF文件第54页浏览型号10M08SCU169I7G的Datasheet PDF文件第55页浏览型号10M08SCU169I7G的Datasheet PDF文件第56页  
    M10-DATASHEET  
    2015.05.04  
    52  
    Single Supply Devices LVDS Receiver Timing Specifications  
    –C7, –I7  
    –A7  
    –C8  
    Symbol  
    Parameter  
    Mode  
    Unit  
    Min  
    100  
    80  
    70  
    40  
    20  
    10  
    5
    Max  
    290  
    290  
    290  
    290  
    290  
    290  
    100  
    100  
    100  
    100  
    100  
    200  
    200  
    200  
    200  
    200  
    200  
    200  
    800  
    Min  
    100  
    80  
    70  
    40  
    20  
    10  
    5
    Max  
    200  
    200  
    200  
    200  
    200  
    200  
    100  
    100  
    100  
    100  
    100  
    200  
    200  
    200  
    200  
    200  
    200  
    200  
    800  
    Min  
    100  
    80  
    70  
    40  
    20  
    10  
    5
    Max  
    200  
    200  
    200  
    200  
    200  
    200  
    100  
    100  
    100  
    100  
    100  
    200  
    200  
    200  
    200  
    200  
    200  
    200  
    800  
    ×10  
    ×8  
    ×7  
    ×4  
    ×2  
    ×1  
    ×10  
    ×8  
    ×7  
    ×4  
    ×2  
    ×1  
    ×10  
    ×8  
    ×7  
    ×4  
    ×2  
    ×1  
    —
    Mbps  
    Mbps  
    Mbps  
    Mbps  
    Mbps  
    Mbps  
    MHz  
    MHz  
    MHz  
    MHz  
    MHz  
    MHz  
    Mbps  
    Mbps  
    Mbps  
    Mbps  
    Mbps  
    Mbps  
    ps  
    Data rate (high-speed I/  
    O performance pin)  
    HSIODR  
    5
    5
    5
    Input clock frequency  
    (low-speed I/O  
    5
    5
    5
    fHSCLK  
    5
    5
    5
    performance pin)  
    5
    5
    5
    5
    5
    5
    100  
    80  
    70  
    40  
    20  
    10  
    —
    100  
    80  
    70  
    40  
    20  
    10  
    —
    100  
    80  
    70  
    40  
    20  
    10  
    —
    Data rate (low-speed I/  
    O performance pin)  
    HSIODR  
    Sampling window  
    (high-speed I/O  
    performance pin)  
    SW  
    Sampling window (low-  
    speed I/O performance  
    pin)  
    —
    —
    1,000  
    —
    1,000  
    —
    1,000  
    ps  
    MAX 10 FPGA Device Datasheet  
    Send Feedback  
    Altera Corporation  

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