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EP1S20F672C7N 参数 Datasheet PDF下载

EP1S20F672C7N图片预览
型号: EP1S20F672C7N
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内容描述: [Field Programmable Gate Array, 2132 CLBs, 18460-Cell, CMOS, PBGA672, 35 X 35 MM, 1.27 MM PITCH, LEAD FREE, BGA-672]
分类和应用:
文件页数/大小: 292 页 / 1528 K
品牌: ALTERA [ ALTERA CORPORATION ]
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Table 4–126. High-Speed I/O Specifications for Wire-Bond Packages (Part 2 of 2)  
-6 Speed Grade  
-7 Speed Grade  
-8 Speed Grade  
Symbol  
Conditions  
Unit  
Min  
Typ  
Max  
Min  
Typ  
Max  
Min  
Typ  
Max  
SW  
PCML (J = 4, 7, 8, 10) only  
PCML (J = 2) only  
800  
1,200  
1,700  
550  
800  
1,200  
1,700  
550  
800  
1,200  
1,700  
550  
ps  
ps  
ps  
ps  
PCML (J = 1) only  
LVDS and LVPECL (J = 1)  
only  
LVDS, LVPECL,  
500  
500  
500  
ps  
HyperTransport technology  
(J = 2 through 10) only  
Input jitter tolerance  
(peak-to-peak)  
All  
250  
200  
250  
200  
250  
200  
ps  
ps  
Output jitter (peak-to-  
peak)  
All  
Output tRISE  
LVDS  
80  
120  
100  
80  
110  
170  
135  
110  
110  
170  
135  
145  
50  
120  
200  
150  
135  
120  
200  
160  
175  
52.5  
55  
80  
120  
100  
80  
110  
170  
135  
110  
110  
170  
135  
145  
50  
120  
200  
150  
135  
120  
200  
160  
175  
52.5  
55  
80  
120  
100  
80  
110  
170  
135  
110  
110  
170  
135  
145  
50  
120  
200  
150  
135  
120  
200  
160  
175  
52.5  
55  
ps  
ps  
ps  
ps  
ps  
ps  
ps  
ps  
%
HyperTransport technology  
LVPECL  
PCML  
Output tFALL  
LVDS  
80  
80  
80  
HyperTransport  
LVPECL  
PCML  
110  
100  
110  
110  
100  
110  
47.5  
45  
110  
100  
110  
47.5  
45  
tDUTY  
LVDS (J = 2 through10) only 47.5  
LVDS (J =1) and LVPECL,  
PCML, HyperTransport  
technology  
45  
50  
50  
50  
%
tLOCK  
All  
100  
100  
100  
μs  
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