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    SAK-TC399XP-256F300S BC 参数 Datasheet PDF下载

    SAK-TC399XP-256F300S BC图片预览
    型号： SAK-TC399XP-256F300S BC
    PDF下载： 下载PDF文件 查看货源
    内容描述： [Infineon releases its second generation AURIX microcontroller in embedded flash 40 nm technology. It comes back with an increase in performance, memory sizes, connectivity and more scalability to address the new automotive trends and challenges. This family has more than 20 products to provide the most scalable portfolio of safety microcontrol­ler. In terms of performance, the highest end product TC39x offers 6 cores running at 300 MHz and up to 6.9 MBytes embedded RAM, and consuming below 2 W. ]
    分类和应用：
    文件页数/大小： 548 页 / 21256 K
    品牌： INFINEON [ Infineon ]
     浏览型号SAK-TC399XP-256F300S BC的Datasheet PDF文件第495页浏览型号SAK-TC399XP-256F300S BC的Datasheet PDF文件第496页浏览型号SAK-TC399XP-256F300S BC的Datasheet PDF文件第497页浏览型号SAK-TC399XP-256F300S BC的Datasheet PDF文件第498页浏览型号SAK-TC399XP-256F300S BC的Datasheet PDF文件第500页浏览型号SAK-TC399XP-256F300S BC的Datasheet PDF文件第501页浏览型号SAK-TC399XP-256F300S BC的Datasheet PDF文件第502页浏览型号SAK-TC399XP-256F300S BC的Datasheet PDF文件第503页  
    TC39x BC/BD-Step  
    Electrical SpecificationInter-IC (I2C) Interface Timing  
    Table 3-65 I2C High Speed Mode Timing  
    Parameter Symbol  
    Values  
    Typ.  
    Unit  
    Note / Test Condition  
    Min.  
    -
    Max.  
    400  
    40 1)  
    80 1)  
    40 1)  
    80 1)  
    70 1)  
    -
    Capacitive load for each bus line Cb SR  
    -
    -
    -
    -
    -
    -
    -
    -
    -
    -
    pF  
    ns  
    ns  
    ns  
    ns  
    ns  
    ns  
    ns  
    ns  
    ns  
    Fall time of SCL  
    t11  
    t12  
    t13  
    t14  
    t3  
    10 1)  
    10 1)  
    10 1)  
    10 1)  
    0 1)  
    10 1)  
    160 1)  
    60 1)  
    160 1)  
    bus line load of 100pF  
    bus line load of 100pF  
    bus line load of 100pF  
    bus line load of 100pF  
    bus line load of 100pF  
    bus line load of 100pF  
    bus line load of 100pF  
    bus line load of 100pF  
    bus line load of 100pF  
    Fall time of SDA  
    Rise time of SCL  
    Rise time of SDA  
    Data hold time  
    Data set-up time  
    t4  
    Low period of SCL clock  
    High period of SCL clock  
    t5  
    -
    t6  
    -
    Hold time for the (repeated)  
    START condition  
    t7  
    -
    Set-up time for (repeated)  
    START condition  
    t8  
    160 1)  
    160 1)  
    -
    -
    -
    -
    ns  
    ns  
    bus line load of 100pF  
    bus line load of 100pF  
    Set-up time for STOP condition t9  
    1) Values are defined for Cb = 100pF, for the Timing of Cb = 400pF see the I2C Standard.  
    t1  
    t2  
    t4  
    70%  
    30%  
    SDA  
    SCL  
    t1  
    t3  
    t2  
    t6  
    9th  
    clock  
    t7  
    t5  
    t10  
    S
    SDA  
    SCL  
    t8  
    t7  
    t9  
    9th  
    clock  
    Sr  
    P
    S
    Figure 3-23 I2C Standard and Fast Mode Timing  
    Data Sheet  
    499  
    V 1.2, 2021-03  
    OPEN MARKET VERSION  

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