TMS320F28027, TMS320F28027-Q1, TMS320F28027F, TMS320F28027F-Q1, TMS320F28026
TMS320F28026-Q1, TMS320F28026F, TMS320F28026F-Q1, TMS320F28023
TMS320F28023-Q1, TMS320F28022, TMS320F28021, TMS320F28020, TMS320F280200
ZHCSA13P –NOVEMBER 2008 –REVISED FEBRUARY 2021
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终端
I/O/Z
说明
PT
引脚编号
DA
引脚编号
名称(1)
时钟
参阅GPIO18。源自SYSCLKOUT 的输出时钟。XCLKOUT 频率要么与
SYSCLKOUT 的频率相同，要么是后者的一半或四分之一。这通过XCLK 寄存器中
的位1:0 (XCLKOUTDIV) 控制。复位时，XCLKOUT = SYSCLKOUT/4。通过将
XCLKOUTDIV 设定为3，可关闭XCLKOUT 信号。GPIO18 的多路复用器控制也必
须设定为XCLKOUT，才能使此信号传播到引脚。
XCLKOUT
O/Z
参阅GPIO18
参阅GPIO19 和GPIO38。外部振荡器输入。时钟的引脚源由XCLK 寄存器内的
XCLKINSEL 位控制，默认选择GPIO38。此引脚馈送来自外部3.3V 振荡器的时
钟。在这种情况下，X1 引脚（如果可用）必须连接至GND，而且必须通过
CLKCTL 寄存器内的14 位禁用片上晶体振荡器。如果使用晶振/谐振器，必须通过
CLKCTL 寄存器内的13 位禁用XCLKIN 路径。
XCLKIN
I
参阅GPIO19 和GPIO38
注意：使用GPIO38/TCK/XCLKIN 引脚提供外部时钟以使器件正常工作的设计可能
需要集成一些挂钩，以便在使用JTAG 连接器调试期间禁用此路径。这是为了防止
JTAG 调试会话期间活动的TCK 信号相互竞争。此时可使用零引脚内部振荡器为器
件计时。
1.8V 片上晶体振荡器输入。要使用此振荡器，必须在X1 和X2 之间连接一个石英
晶振或陶瓷谐振器。在这种情况下，必须通过CLKCTL 寄存器内的13 位禁用
XCLKIN 路径。如果此引脚未使用，必须连接至GND。(I)
X1
X2
45
46
-
I
片上晶体振荡器输出。必须在X1 和X2 之间连接一个石英晶振或陶瓷谐振器。如果
X2 未使用，必须保持未连接状态。(O)
O
–
复位
器件复位（进）和看门狗复位（出）。这些器件具有内置上电复位(POR) 电路和欠
压复位(BOR) 电路。在上电或欠压情况下，此引脚由器件驱动为低电平。外部电路
也可能会驱动此引脚使器件复位生效。发生看门狗复位时，此引脚也由MCU 驱动
为低电平。在看门狗复位期间，XRS 引脚在512 个OSCCLK 周期的看门狗复位持
续时间内被驱动为低电平。应在XRS 和VDDIO 之间放置一个值为2.2kΩ至10kΩ
的电阻器。如果在XRS 和VSS 之间放置一个电容器进行噪声滤除，则该电容器的
值应为100nF 或更小。当看门狗复位生效时，这些值将能让看门狗在512 个
OSCCLK 周期内正确地将XRS 引脚驱动至VOL。任何源头的器件复位都会导致器
件终止执行。程序计数器指向位置0x3F FFC0 包含的地址。当复位失效时，从程序
计数器指定的位置开始执行。此引脚的输出缓冲器是一个有内部上拉电阻的开漏器
件。(↑) 如果此引脚由外部器件驱动，则应使用开漏器件进行驱动。
XRS
3
17
I/OD
ADC、比较器、模拟I/O
ADC 组A，通道7 输入
ADC 组A，通道6 输入
数字AIO 6
ADCINA7
ADCINA6
AIO6
6
4
I
–
I
18
I/O
ADCINA4
COMP2A
AIO4
I
ADC 组A，通道4 输入
比较器输入2A（只在48 引脚器件内可用）
数字AIO 4
5
7
9
19
I
I/O
ADCINA3
ADCINA2
COMP1A
AIO2
I
ADC 组A，通道3 输入
ADC 组A，通道2 输入
比较器输入1A
–
I
20
I
I/O
数字AIO 2
ADCINA1
ADCINA0
VREFHI
8
-
I
ADC 组A，通道1 输入
ADC 组A，通道0 输入
ADC 外部基准高- 仅在ADC 外部基准模式下使用。参阅节9.9.1.1，ADC。
ADC 组B，通道7 输入
ADC 组B，通道6 输入
数字AIO 14
I
10
18
17
21
-
I
I
ADCINB7
ADCINB6
AIO14
I
26
I/O
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