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EP3C16Q240C8N 参数 Datasheet PDF下载

EP3C16Q240C8N图片预览
型号: EP3C16Q240C8N
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内容描述: [Field Programmable Gate Array, 15408 CLBs, 472.5MHz, 15408-Cell, CMOS, PQFP240, 34.60 X 34.60 MM, 4.10 MM HEIGHT, 0.50 MM PITCH, PLASTIC, LEAD FREE, QFP-240]
分类和应用: 时钟可编程逻辑
文件页数/大小: 34 页 / 836 K
品牌: INTEL [ INTEL ]
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1–12  
Chapter 1: Cyclone III Device Datasheet  
Electrical Characteristics  
f
For more illustrations of receiver input and transmitter output waveforms, and for  
other differential I/O standards, refer to the High-Speed Differential Interfaces in  
Cyclone III Devices chapter.  
Table 1–16. Cyclone III Devices Differential SSTL I/O Standard Specifications (1)  
VSwing(AC)  
(V)  
VCCIO (V)  
VSwing(DC) (V)  
VX(AC) (V)  
Typ  
VOX(AC) (V)  
Typ  
I/O Standard  
Min Typ Max Min Max  
Min  
Max  
Min Max  
Min  
Max  
SSTL-2  
Class I, II  
V
+ 0.2  
CCIO/2  
VCCI  
0.7  
VCCIO/2 –  
0.125  
V
CCIO/2  
2.375 2.5 2.625 0.36 VCCIO VCCIO/2 – 0.2  
VCCIO/2 –  
+ 0.125  
O
SSTL-18  
Class I, II  
V
CCIO/2  
VCCI  
0.5  
VCCIO/2 –  
0.125  
VCCIO/2  
+ 0.125  
1.7  
1.8 1.90 0.25 VCCIO  
0.175  
+ 0.175  
O
Note to Table 1–16:  
(1) Differential SSTL requires a VREF input.  
Table 1–17. Cyclone III Devices Differential HSTL I/O Standard Specifications (1)  
V
CCIO (V)  
VDIF(DC) (V)  
VX(AC) (V)  
Typ  
VCM(DC) (V)  
Typ  
VDIF(AC) (V)  
I/O Standard  
Mi  
Min Typ Max Min Max  
Min  
0.85  
0.71  
Max  
0.95  
0.79  
Min  
0.85  
0.71  
Max  
0.95  
0.79  
Max  
n
HSTL-18  
Class I, II  
1.71 1.8 1.89 0.2  
1.425 1.5 1.575 0.2  
0.4  
HSTL-15  
Class I, II  
0.4  
0.3  
HSTL-12  
Class I, II  
0.52 *  
VCCIO  
0.48 *  
VCCIO  
0.52 *  
VCCIO  
0.48 *  
VCCIO  
1.14 1.2 1.26 0.16 VCCIO 0.48 * VCCIO  
Note to Table 1–17:  
(1) Differential HSTL requires a VREF input.  
(1)  
Table 1–18. Cyclone III Devices Differential I/O Standard Specifications  
(Part 1 of 2)  
VOD (mV)  
Max Min Typ Max Min Typ Max  
(2)  
(3)  
(3)  
V
CCIO (V)  
VID (mV)  
VIcM (V)  
VOS (V)  
I/O  
Standard  
Min Typ Max  
Min Max Min  
Condition  
0.05  
DMAX500 Mbps 1.80  
LVPECL  
500 Mbps DMAX  
700 Mbps  
(Row I/Os) 2.375 2.5 2.625 100  
0.55  
1.80  
1.55  
(4)  
1.05 DMAX > 700 Mbps  
0.05  
DMAX 500 Mbps 1.80  
LVPECL  
500 Mbps DMAX  
700 Mbps  
(Column  
2.375 2.5 2.625 100  
2.375 2.5 2.625 100  
0.55  
1.80  
(4)  
I/Os)  
1.05  
0.05  
DMAX > 700 Mbps  
1.55  
DMAX 500 Mbps 1.80  
LVDS (Row  
I/Os)  
500 Mbps DMAX  
700 Mbps  
0.55  
1.05  
1.80 247  
1.55  
600 1.125 1.25 1.375  
DMAX > 700 Mbps  
Cyclone III Device Handbook  
Volume 2  
July 2012 Altera Corporation  
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