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TDA5235 参数 Datasheet PDF下载

TDA5235图片预览

型号：	TDA5235
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内容描述：	增强灵敏度双配置接收器，具有数字基带处理 [Enhanced Sensitivity Double-Configuration Receiver with Digital Baseband Processing]
分类和应用：
文件页数/大小：	259 页 / 6799 K
品牌：	INFINEON [ Infineon ]

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TDA5235

Appendix

Register Overview

Table 2

Register Overview and Reset Value (cont’d)

Register Short Name

PPCFG0

Register Long Name

Offset Address Reset Value

PP0 and PP1 Configuration Register

PP2 and PP3 Configuration Register

PPx Port Configuration Register

RX RUN Configuration Register 0

RX RUN Configuration Register 1

Clock Divider Register 0

081_H

082_H

083_H

084_H

085_H

086_H

087_H

088_H

089_H

08A_H

08B_H

08C_H

08D_H

08E_H

08F_H

090_H

091_H

092_H

50_H

12_H

00_H

FF_H

FF_H

0B_H

00_H

00_H

07_H

07_H

04_H

10_H

00_H

01_H

00_H

80_H

80_H

1E_H

PPCFG1

PPCFG2

RXRUNCFG0

RXRUNCFG1

CLKOUT0

CLKOUT1

Clock Divider Register 1

CLKOUT2

Clock Divider Register 2

RFC

RF Control Register

BPFCALCFG0

BPFCALCFG1

XTALCAL0

XTALCAL1

RSSIMONC

ADCINSEL

RSSIOFFS

RSSISLOPE

CDRDRTHRP

BPF Calibration Configuration Register 0

BPF Calibration Configuration Register 1

XTAL Coarse Calibration Register

XTAL Fine Calibration Register

RSSI Monitor Configuration Register

ADC Input Selection Register

RSSI Offset Register

RSSI Slope Register

CDR Data Rate Acceptance Positive Threshold

Register

CDRDRTHRN

CDR Data Rate Acceptance Negative Threshold 093_H

Register

23_H

IM0

Interrupt Mask Register 0

094_H

096_H

097_H

098_H

099_H

09A_H

09B_H

09C_H

09D_H

09E_H

09F_H

0A4_H

0A5_H

0A6_H

0A7_H

0A8_H

0AA_H

00_H

01_H

01_H

00_H

01_H

01_H

00_H

01_H

00_H

01_H

00_H

00_H

04_H

10_H

00_H

FF_H

00_H

SPMAP

Self Polling Mode Active Periods Register

Self Polling Mode Idle Periods Register

Self Polling Mode Control Register

SPMIP

SPMC

SPMRT

Self Polling Mode Reference Timer Register

Self Polling Mode Off Time Register 0

Self Polling Mode Off Time Register 1

Self Polling Mode On Time Config A Register 0

Self Polling Mode On Time Config A Register 1

Self Polling Mode On Time Config B Register 0

Self Polling Mode On Time Config B Register 1

External Processing Command Register

Chip Mode Control Register 1

SPMOFFT0

SPMOFFT1

SPMONTA0

SPMONTA1

SPMONTB0

SPMONTB1

EXTPCMD

CMC1

CMC0

Chip Mode Control Register 0

RSSIPWU

IS0

Wakeup Peak Detector Readout Register

Interrupt Status Register 0

RFPLLACC

RF PLL Actual Channel and Configuration

Register

Data Sheet

175

V1.0, 2010-02-19

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