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TDA5235 参数 Datasheet PDF下载

TDA5235图片预览

型号：	TDA5235
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内容描述：	增强灵敏度双配置接收器，具有数字基带处理 [Enhanced Sensitivity Double-Configuration Receiver with Digital Baseband Processing]
分类和应用：
文件页数/大小：	259 页 / 6799 K
品牌：	INFINEON [ Infineon ]

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TDA5235

Appendix

Register Overview

Table 2

Register Overview and Reset Value (cont’d)

Register Short Name

B_MID19

Register Long Name

Offset Address Reset Value

Message ID Register 19

Message ID Control Register 0

Message ID Control Register 1

IF1 Register

113_H

114_H

115_H

116_H

117_H

118_H

119_H

11A_H

00_H

00_H

00_H

20_H

04_H

00_H

00_H

00_H

00_H

FF_H

B_MIDC0

B_MIDC1

B_IF1

B_WUC

Wake-Up Control Register

Wake-Up Pattern Register 0

Wake-Up Pattern Register 1

Wake-Up Bit or Chip Count Register

B_WUPAT0

B_WUPAT1

B_WUBCNT

B_WURSSITH1

B_WURSSIBL1

RSSI Wake-Up Threshold for Channel 1 Register 11B_H

RSSI Wake-Up Blocking Level Low Channel 1

Register

11C_H

B_WURSSIBH1

RSSI Wake-Up Blocking Level High Channel 1

Register

11D_H

00_H

B_SIGDETSAT

B_WULOT

Signal Detector Saturation Threshold Register

Wake-Up on Level Observation Time Register

Synchronization Search Time-Out Register

SYNC Timeout Timer Register

124_H

125_H

126_H

127_H

128_H

129_H

12A_H

12B_H

12C_H

12D_H

12E_H

12F_H

130_H

131_H

132_H

133_H

134_H

135_H

136_H

137_H

138_H

139_H

13A_H

13B_H

13C_H

13D_H

10_H

00_H

87_H

FF_H

00_H

00_H

02_H

00_H

00_H

00_H

00_H

00_H

00_H

42_H

00_H

2B_H

03_H

08_H

40_H

00_H

07_H

00_H

00_H

20_H

07_H

00_H

B_SYSRCTO

B_TOTIM_SYNC

B_TOTIM_TSI

B_TOTIM_EOM

B_AFCLIMIT

B_AFCAGCD

B_AFCSFCFG

B_AFCK1CFG0

B_AFCK1CFG1

B_AFCK2CFG0

B_AFCK2CFG1

B_PMFUDSF

B_AGCSFCFG

B_AGCCFG0

B_AGCCFG1

B_AGCTHR

TSI Timeout Timer Register

EOM Timeout Timer Register

AFC Limit Configuration Register

AFC/AGC Freeze Delay Register

AFC Start/Freeze Configuration Register

AFC Integrator 1 Gain Register 0

AFC Integrator 1 Gain Register 1

AFC Integrator 2 Gain Register 0

AFC Integrator 2 Gain Register 1

Peak Memory Filter Up-Down Factor Register

AGC Start/Freeze Configuration Register

AGC Configuration Register 0

AGC Configuration Register 1

AGC Threshold Register

B_DIGRXC

Digital Receiver Configuration Register

RSSI Peak Detector Bit Position Register

Image Supression Fc Selection Register

Pre Decimation Factor Register

B_PKBITPOS

B_ISUPFCSEL

B_PDECF

B_PDECSCFSK

B_PDECSCASK

B_MFC

Pre Decimation Scaling Register FSK Mode

Pre Decimation Scaling Register ASK Mode

Matched Filter Control Register

B_SRC

Sampe Rate Converter NCO Tune

Data Sheet

177

V1.0, 2010-02-19

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