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EP1SGX40GF1020I6N 参数 Datasheet PDF下载

EP1SGX40GF1020I6N图片预览

型号：	EP1SGX40GF1020I6N
PDF下载：	下载PDF文件查看货源
内容描述：	[Field Programmable Gate Array, 4697 CLBs, 41250-Cell, CMOS, PBGA1020, 33 X 33 MM, 1 MM PITCH, LEAD FREE, FBGA-1020]
分类和应用：	栅可编程逻辑
文件页数/大小：	279 页 / 3682 K
品牌：	ALTERA [ ALTERA CORPORATION ]

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Stratix GX Architecture

Table 4–36. Stratix GX JTAG Timing Parameters & Values (Part 2 of 2)

Symbol

t_JPH

Parameter

Min (ns) Max (ns)

JTAG port hold time

45

25

25

25

20

45

35

35

35

t_JPCO

t_JPZX

t_JPXZ

t_JSSU

t_JSH

JTAG port clock to output

JTAG port high impedance to valid output

JTAG port valid output to high impedance

Capture register setup time

Capture register hold time

t_JSCO

t_JSZX

t_JSXZ

Update register clock to output

Update register high impedance to valid output

Update register valid output to high impedance

Altera Corporation

February 2005

4–125

Stratix GX Device Handbook, Volume 1

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