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XC3S100E-4VQG100CS1 参数 Datasheet PDF下载

XC3S100E-4VQG100CS1图片预览

型号：	XC3S100E-4VQG100CS1
PDF下载：	下载PDF文件查看货源
内容描述：	[Field Programmable Gate Array, 572MHz, 2160-Cell, CMOS, PQFP100,]
分类和应用：	时钟栅可编程逻辑
文件页数/大小：	227 页 / 6528 K
品牌：	XILINX [ XILINX, INC ]

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Spartan-3E FPGA Family: Pinout Descriptions

Table 153: FG484 Package Pinout (Cont’d)

Table 153: FG484 Package Pinout (Cont’d)

XC3S1600E

Pin Name

FG484

Ball

XC3S1600E

Pin Name

FG484

Ball

Bank

Type

Bank

Type

1

1

1

1

1

1

1

1

1

1

1

1

1

1

1

1

1

1

1

1

1

1

1

1

1

1

1

1

1

1

1

1

1

1

1

1

1

1

1

1

1

1

1

1

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IO_L30P_1

IO_L31N_1

IO_L31P_1

IO_L32N_1

IO_L32P_1

IO_L33N_1

IO_L33P_1

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IO_L34P_1

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IO_L35P_1

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IO_L36P_1

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IP

J17

J18

I/O

I/O

1

1

1

1

1

2

2

2

2

2

2

2

2

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2

2

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2

2

2

2

2

2

2

2

2

2

2

2

2

VCCO_1

VCCO_1

K21

L16

P21

R17

V21

Y8

VCCO

VCCO

VCCO

VCCO

VCCO

I/O

H21

H22

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G22

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G20

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I/O

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VCCO_1

I/O

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I/O

IO

I/O

IO

Y9

I/O

I/O

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Y5

I/O

I/O

IO

I/O

I/O

IO

I/O

I/O

IO

I/O

I/O

IO

I/O

I/O

IO

I/O

I/O

IO/D5

DUAL

DUAL

VREF

VREF

DUAL

DUAL

DUAL

DUAL

I/O

I/O

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I/O

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IO/VREF_2

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IO_L14P_2

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IO_L17P_2

I/O

I/O

I/O

I/O

DUAL

DUAL

DUAL

DUAL

INPUT

INPUT

INPUT

INPUT

INPUT

INPUT

INPUT

INPUT

INPUT

INPUT

INPUT

INPUT

INPUT

INPUT

INPUT

INPUT

VREF

VREF

VCCO

VCCO

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W6

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I/O

W7

I/O

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I/O

IP

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I/O

IP

V7

I/O

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I/O

IP

W8

IP

J22

T8

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IP

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IP

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IP

I/O

IP

I/O

IP

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I/O

IP

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I/O

IP

I/O

IP

I/O

IP/VREF_1

IP/VREF_1

VCCO_1

VCCO_1

I/O

I/O

I/O

DS312 (v4.2) December 14, 2018

www.xilinx.com

Product Specification

219

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