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XC3S100E-4VQG100CS1 参数 Datasheet PDF下载

XC3S100E-4VQG100CS1图片预览
型号: XC3S100E-4VQG100CS1
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内容描述: [Field Programmable Gate Array, 572MHz, 2160-Cell, CMOS, PQFP100,]
分类和应用: 时钟可编程逻辑
文件页数/大小: 227 页 / 6528 K
品牌: XILINX [ XILINX, INC ]
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Spartan-3E FPGA Family: Pinout Descriptions  
FG320  
Table 147: FG320 Package Pinout (Cont’d)  
Bank  
XC3S500E Pin Name  
IO_L08P_0  
XC3S1200E Pin Name  
XC3S1600E Pin Name  
Type  
Ball  
E11  
D11  
C11  
E10  
D10  
A10  
B10  
D9  
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
IO_L08P_0  
IO_L08P_0  
I/O  
I/O  
IO_L09N_0  
IO_L09N_0  
IO_L09N_0  
IO_L09P_0  
IO_L09P_0  
IO_L09P_0  
I/O  
IO_L11N_0/GCLK5  
IO_L11P_0/GCLK4  
IO_L12N_0/GCLK7  
IO_L12P_0/GCLK6  
IO_L14N_0/GCLK11  
IO_L14P_0/GCLK10  
IO_L15N_0  
IO_L11N_0/GCLK5  
IO_L11P_0/GCLK4  
IO_L12N_0/GCLK7  
IO_L12P_0/GCLK6  
IO_L14N_0/GCLK11  
IO_L14P_0/GCLK10  
IO_L15N_0  
IO_L11N_0/GCLK5  
IO_L11P_0/GCLK4  
IO_L12N_0/GCLK7  
IO_L12P_0/GCLK6  
IO_L14N_0/GCLK11  
IO_L14P_0/GCLK10  
IO_L15N_0  
GCLK  
GCLK  
GCLK  
GCLK  
GCLK  
GCLK  
I/O  
C9  
F9  
IO_L15P_0  
IO_L15P_0  
IO_L15P_0  
E9  
I/O  
IO_L17N_0  
IO_L17N_0  
IO_L17N_0  
F8  
I/O  
IO_L17P_0  
IO_L17P_0  
IO_L17P_0  
E8  
I/O  
IO_L18N_0/VREF_0  
IO_L18P_0  
IO_L18N_0/VREF_0  
IO_L18P_0  
IO_L18N_0/VREF_0  
IO_L18P_0  
D7  
VREF  
I/O  
C7  
IO_L19N_0/VREF_0  
IO_L19P_0  
IO_L19N_0/VREF_0  
IO_L19P_0  
IO_L19N_0/VREF_0  
IO_L19P_0  
E7  
VREF  
I/O  
F7  
IO_L20N_0  
IO_L20N_0  
IO_L20N_0  
A6  
I/O  
IO_L20P_0  
IO_L20P_0  
IO_L20P_0  
B6  
I/O  
N.C. ()  
IO_L21N_0  
IO_L21N_0  
E6  
500E: N.C.  
1200E: I/O  
1600E: I/O  
0
N.C. ()  
IO_L21P_0  
IO_L21P_0  
D6  
500E: N.C.  
1200E: I/O  
1600E: I/O  
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
IO_L23N_0/VREF_0  
IO_L23P_0  
IO_L24N_0  
IO_L24P_0  
IO_L25N_0/HSWAP  
IO_L25P_0  
IP  
IO_L23N_0/VREF_0  
IO_L23P_0  
IO_L24N_0  
IO_L24P_0  
IO_L25N_0/HSWAP  
IO_L25P_0  
IP  
IO_L23N_0/VREF_0  
IO_L23P_0  
IO_L24N_0  
IO_L24P_0  
IO_L25N_0/HSWAP  
IO_L25P_0  
IP  
D5  
C5  
VREF  
I/O  
B4  
I/O  
A4  
I/O  
B3  
DUAL  
I/O  
C3  
A3  
INPUT  
INPUT  
INPUT  
INPUT  
INPUT  
INPUT  
INPUT  
INPUT  
GCLK  
GCLK  
INPUT  
INPUT  
INPUT  
INPUT  
IP  
IP  
IP  
C15  
A15  
B15  
D12  
C12  
G10  
F10  
B9  
IP_L02N_0  
IP_L02P_0  
IP_L07N_0  
IP_L07P_0  
IP_L10N_0  
IP_L10P_0  
IP_L13N_0/GCLK9  
IP_L13P_0/GCLK8  
IP_L16N_0  
IP_L16P_0  
IP_L22N_0  
IP_L22P_0  
IP_L02N_0  
IP_L02P_0  
IP_L07N_0  
IP_L07P_0  
IP_L10N_0  
IP_L10P_0  
IP_L13N_0/GCLK9  
IP_L13P_0/GCLK8  
IP_L16N_0  
IP_L16P_0  
IP_L22N_0  
IP_L22P_0  
IP_L02N_0  
IP_L02P_0  
IP_L07N_0  
IP_L07P_0  
IP_L10N_0  
IP_L10P_0  
IP_L13N_0/GCLK9  
IP_L13P_0/GCLK8  
IP_L16N_0  
IP_L16P_0  
IP_L22N_0  
IP_L22P_0  
B8  
D8  
C8  
B5  
A5  
DS312 (v4.2) December 14, 2018  
www.xilinx.com  
Product Specification  
198  
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