Spartan-3E FPGA Family: Pinout Descriptions
FG320
Table 147: FG320 Package Pinout (Cont’d)
Bank
XC3S500E Pin Name
IO_L20P_2
XC3S1200E Pin Name
XC3S1600E Pin Name
Type
Ball
T12
P12
2
2
IO_L20P_2
IO_L21N_2
IO_L20P_2
IO_L21N_2
I/O
N.C. ()
500E: N.C.
1200E: I/O
1600E: I/O
2
N.C. ()
IO_L21P_2
IO_L21P_2
N12
500E: N.C.
1200E: I/O
1600E: I/O
2
2
2
2
2
2
2
2
2
2
2
2
2
2
2
2
2
2
IO_L22N_2/A22
IO_L22P_2/A23
IO_L24N_2/A20
IO_L24P_2/A21
IO_L25N_2/VS1/A18
IO_L25P_2/VS2/A19
IO_L26N_2/CCLK
IO_L26P_2/VS0/A17
IP
IO_L22N_2/A22
IO_L22P_2/A23
IO_L24N_2/A20
IO_L24P_2/A21
IO_L25N_2/VS1/A18
IO_L25P_2/VS2/A19
IO_L26N_2/CCLK
IO_L26P_2/VS0/A17
IP
IO_L22N_2/A22
IO_L22P_2/A23
IO_L24N_2/A20
IO_L24P_2/A21
IO_L25N_2/VS1/A18
IO_L25P_2/VS2/A19
IO_L26N_2/CCLK
IO_L26P_2/VS0/A17
IP
R13
P13
R14
T14
U15
V15
U16
T16
V2
DUAL
DUAL
DUAL
DUAL
DUAL
DUAL
DUAL
DUAL
INPUT
INPUT
INPUT
INPUT
INPUT
INPUT
VREF
IP
IP
IP
V16
V3
IP_L02N_2
IP_L02N_2
IP_L02N_2
IP_L02P_2
IP_L02P_2
IP_L02P_2
V4
IP_L08N_2
IP_L08N_2
IP_L08N_2
R7
IP_L08P_2
IP_L08P_2
IP_L08P_2
T7
IP_L11N_2/VREF_2
IP_L11P_2
IP_L11N_2/VREF_2
IP_L11P_2
IP_L11N_2/VREF_2
IP_L11P_2
V8
U8
INPUT
DUAL/GCLK
DUAL/GCLK
IP_L14N_2/M2/GCLK1
IP_L14N_2/M2/GCLK1
IP_L14N_2/M2/GCLK1
T10
U10
IP_L14P_2/RDWR_B/
GCLK0
IP_L14P_2/RDWR_B/
GCLK0
IP_L14P_2/RDWR_B/
GCLK0
2
2
2
2
2
2
2
2
2
3
IP_L17N_2
IP_L17P_2
IP_L23N_2
IP_L23P_2
VCCO_2
VCCO_2
VCCO_2
VCCO_2
VCCO_2
N.C. ()
IP_L17N_2
IP_L17P_2
IP_L23N_2
IP_L23P_2
VCCO_2
VCCO_2
VCCO_2
VCCO_2
VCCO_2
IO
IP_L17N_2
IP_L17P_2
IP_L23N_2
IP_L23P_2
VCCO_2
VCCO_2
VCCO_2
VCCO_2
VCCO_2
IO
U11
T11
U14
V14
M8
INPUT
INPUT
INPUT
INPUT
VCCO
VCCO
VCCO
VCCO
VCCO
M11
T6
T13
V10
D4
500E: N.C.
1200E: I/O
1600E: I/O
3
3
3
3
3
3
IO_L01N_3
IO_L01N_3
IO_L01N_3
C2
C1
D2
D1
E1
E2
I/O
I/O
IO_L01P_3
IO_L01P_3
IO_L01P_3
IO_L02N_3/VREF_3
IO_L02P_3
IO_L02N_3/VREF_3
IO_L02P_3
IO_L02N_3/VREF_3
IO_L02P_3
VREF
I/O
IO_L03N_3
IO_L03N_3
IO_L03N_3
I/O
IO_L03P_3
IO_L03P_3
IO_L03P_3
I/O
DS312 (v4.2) December 14, 2018
www.xilinx.com
Product Specification
202
XILINX [ XILINX, INC ]
