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TMS320F28026FPTT 参数 Datasheet PDF下载

TMS320F28026FPTT图片预览
型号: TMS320F28026FPTT
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内容描述: [具有 60MHz 频率、32KB 闪存、InstaSPIN-FOC 的 C2000™ 32 位 MCU | PT | 48 | -40 to 105]
分类和应用: 时钟微控制器外围集成电路装置闪存
文件页数/大小: 140 页 / 4683 K
品牌: TI [ TEXAS INSTRUMENTS ]
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TMS320F28027, TMS320F28027-Q1, TMS320F28027F, TMS320F28027F-Q1, TMS320F28026  
TMS320F28026-Q1, TMS320F28026F, TMS320F28026F-Q1, TMS320F28023  
TMS320F28023-Q1, TMS320F28022, TMS320F28021, TMS320F28020, TMS320F280200  
ZHCSA13P NOVEMBER 2008 REVISED FEBRUARY 2021  
www.ti.com.cn  
9 详细说明  
9.1 Overview  
9.1.1 CPU  
2802x (C28x) 系列是 TMS320C2000微控制器 (MCU) 平台的成员。基于 C28x 的控制器具有与现有 C28x  
MCU 一样32 位定点架构。它是一款高效的 C/C++ 引擎不仅支持用户使用高级语言开发控制软件还支持使  
C/C++ 开发数学算法。此器件在处理 MCU 算术任务时与处理系统控制任务时同样有效而系统控制任务通常  
由微控制器器件处理。鉴于此器件具有高效率无需像很多系统一样使用第二个处理器。利32 x 32 MAC 64  
位处理能力控制器能够高效地处理更高的数值分辨率问题。添加了带有关键寄存器自动环境保存的快速中断响  
使得一个器件能够用最小的延迟处理很多异步事件。此器件有一个具有流水线式存储器访问的 8 级深受保护  
流水线。这个流水线式操作使得此器件能够在高速执行而无需求助于昂贵的高速存储器。特别分支超前硬件大大  
减少了条件不连续而带来的延迟。特别存储条件操作进一步提升了性能。  
9.1.2 Memory Bus (Harvard Bus Architecture)  
As with many MCU-type devices, multiple buses are used to move data between the memories and peripherals  
and the CPU. The memory bus architecture contains a program read bus, data read bus, and data write bus.  
The program read bus consists of 22 address lines and 32 data lines. The data read and write buses consist of  
32 address lines and 32 data lines each. The 32-bit-wide data buses enable single cycle 32-bit operations. The  
multiple bus architecture, commonly termed Harvard Bus, enables the C28x to fetch an instruction, read a data  
value and write a data value in a single cycle. All peripherals and memories attached to the memory bus  
prioritize memory accesses. Generally, the priority of memory bus accesses can be summarized as follows:  
Highest:  
Data Writes  
Program Writes  
Data Reads  
Program Reads  
Fetches  
(Simultaneous data and program writes cannot occur on the memory bus.)  
(Simultaneous data and program writes cannot occur on the memory bus.)  
(Simultaneous program reads and fetches cannot occur on the memory bus.)  
(Simultaneous program reads and fetches cannot occur on the memory bus.)  
Lowest:  
9.1.3 外设总线  
为了在多种德州仪器 (TI) MCU 器件系列间实现外设迁移此器件采用一个针对外设互连的外设总线标准。外设总  
线桥对各个总线进行多路复用使处理器内存总线成为包含 16 条地址线和 16 条或 32 条数据线及关联控制信号  
的单个总线。支持外设总线的三个版本。一个版本只支持 16 位访问被称为外设帧 2。另外版本支持 16 位和  
32 位访问被称为外设1。  
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Q1 TMS320F28022 TMS320F28021 TMS320F28020 TMS320F280200  
 
 
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