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    K4D64163HF-TC33 参数 Datasheet PDF下载

    K4D64163HF-TC33图片预览
    型号： K4D64163HF-TC33
    PDF下载： 下载PDF文件 查看货源
    内容描述： 1米x 16Bit的×4银行双数据速率同步DRAM [1M x 16Bit x 4 Banks Double Data Rate Synchronous DRAM]
    分类和应用： 内存集成电路光电二极管动态存储器双倍数据速率时钟
    文件页数/大小： 16 页 / 164 K
    品牌： SAMSUNG [ SAMSUNG ]
     浏览型号K4D64163HF-TC33的Datasheet PDF文件第1页浏览型号K4D64163HF-TC33的Datasheet PDF文件第2页浏览型号K4D64163HF-TC33的Datasheet PDF文件第3页浏览型号K4D64163HF-TC33的Datasheet PDF文件第5页浏览型号K4D64163HF-TC33的Datasheet PDF文件第6页浏览型号K4D64163HF-TC33的Datasheet PDF文件第7页浏览型号K4D64163HF-TC33的Datasheet PDF文件第8页浏览型号K4D64163HF-TC33的Datasheet PDF文件第9页  
    64M DDR SDRAM  
    K4D64163HF  
    PIN CONFIGURATION (Top View)  
    66  
    65  
    64  
    63  
    62  
    61  
    60  
    59  
    58  
    57  
    56  
    55  
    54  
    53  
    52  
    51  
    50  
    49  
    48  
    47  
    46  
    45  
    44  
    43  
    42  
    41  
    40  
    39  
    38  
    37  
    36  
    35  
    34  
    VSS  
    1
    VDD  
    DQ0  
    VDDQ  
    DQ1  
    DQ2  
    VSSQ  
    DQ3  
    DQ4  
    VDDQ  
    DQ5  
    DQ6  
    VSSQ  
    DQ7  
    NC  
    DQ15  
    VSSQ  
    DQ14  
    DQ13  
    VDDQ  
    DQ12  
    DQ11  
    VSSQ  
    DQ10  
    DQ9  
    VDDQ  
    DQ8  
    NC  
    2
    3
    4
    5
    6
    7
    8
    9
    10  
    11  
    12  
    13  
    14  
    15  
    16  
    17  
    18  
    19  
    20  
    21  
    66 PIN TSOP(II)  
    (400mil x 875mil)  
    (0.65 mm Pin Pitch)  
    VSSQ  
    UDQS  
    NC  
    VDDQ  
    LDQS  
    NC  
    VREF  
    VSS  
    VDD  
    NC  
    UDM  
    CK  
    LDM  
    WE  
    CK  
    CAS  
    RAS  
    CS  
    22  
    23  
    CKE  
    NC  
    24  
    25  
    26  
    27  
    28  
    29  
    30  
    31  
    32  
    33  
    NC  
    NC  
    A11  
    BA0  
    BA1  
    AP/A10  
    A0  
    A9  
    A8  
    A7  
    A6  
    A1  
    A5  
    A2  
    A4  
    A3  
    VSS  
    VDD  
    PIN DESCRIPTION  
    CK,CK  
    CKE  
    Differential Clock Input  
    Clock Enable  
    BA0, BA1  
    A0 ~A11  
    DQ0 ~ DQ15  
    VDD  
    Bank Select Address  
    Address Input  
    Data Input/Output  
    Power  
    CS  
    Chip Select  
    RAS  
    Row Address Strobe  
    Column Address Strobe  
    Write Enable  
    CAS  
    VSS  
    Ground  
    WE  
    VDDQ  
    Power for DQ’s  
    Ground for DQ’s  
    No Connection  
    LDQS,UDQS  
    LDM,UDM  
    Data Strobe  
    VSSQ  
    Data Mask  
    NC  
    - 4 -  
    Rev. 1.1(Aug. 2002)  

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