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EP2S130F1020I4N 参数 Datasheet PDF下载

EP2S130F1020I4N图片预览

型号：	EP2S130F1020I4N
PDF下载：	下载PDF文件查看货源
内容描述：	[Field Programmable Gate Array, 6627 CLBs, 717MHz, 132540-Cell, CMOS, PBGA1020, 33 X 33 MM, 1 MM PITCH, LEAD FREE, FBGA-1020]
分类和应用：	时钟栅可编程逻辑
文件页数/大小：	248 页 / 2983 K
品牌：	INTEL [ INTEL ]

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Stratix II Architecture

Figure 2–43 shows the global and regional clocking from enhanced PLL

outputs and top and bottom CLKpins. The connections to the global and

regional clocks from the top clock pins and enhanced PLL outputs is

shown in Table 2–11. The connections to the clocks from the bottom clock

pins is shown in Table 2–12.

Altera Corporation

May 2007

2–63

Stratix II Device Handbook, Volume 1

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