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    EP2S130F1020I4N 参数 Datasheet PDF下载

    EP2S130F1020I4N图片预览
    型号： EP2S130F1020I4N
    PDF下载： 下载PDF文件 查看货源
    内容描述： [Field Programmable Gate Array, 6627 CLBs, 717MHz, 132540-Cell, CMOS, PBGA1020, 33 X 33 MM, 1 MM PITCH, LEAD FREE, FBGA-1020]
    分类和应用： 时钟栅可编程逻辑
    文件页数/大小： 248 页 / 2983 K
    品牌： INTEL [ INTEL ]
     浏览型号EP2S130F1020I4N的Datasheet PDF文件第79页浏览型号EP2S130F1020I4N的Datasheet PDF文件第80页浏览型号EP2S130F1020I4N的Datasheet PDF文件第81页浏览型号EP2S130F1020I4N的Datasheet PDF文件第82页浏览型号EP2S130F1020I4N的Datasheet PDF文件第84页浏览型号EP2S130F1020I4N的Datasheet PDF文件第85页浏览型号EP2S130F1020I4N的Datasheet PDF文件第86页浏览型号EP2S130F1020I4N的Datasheet PDF文件第87页  
    Stratix II Architecture  
    Table 2–11. Global & Regional Clock Connections from Top Clock Pins & Enhanced PLL Outputs (Part 1  
    of 2)  
    Top Side Global & Regional  
    Clock Network Connectivity  
    Clock pins  
    CLK12p  
    v
    v
    v
    v
    v
    v
    v
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    v
    v
    v
    v
    CLK13p  
    CLK14p  
    CLK15p  
    CLK12n  
    CLK13n  
    CLK14n  
    CLK15n  
    v
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    v
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    v
    v
    Drivers from internal logic  
    GCLKDRV0  
    GCLKDRV1  
    GCLKDRV2  
    GCLKDRV3  
    RCLKDRV0  
    RCLKDRV1  
    RCLKDRV2  
    RCLKDRV3  
    RCLKDRV4  
    RCLKDRV5  
    RCLKDRV6  
    RCLKDRV7  
    v
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    v
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    v
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    v
    Enhanced PLL 5 outputs  
    c0  
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    c1  
    c2  
    c3  
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    v
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    v
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    v
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    Altera Corporation  
    May 2007  
    2–65  
    Stratix II Device Handbook, Volume 1  

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