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    ICS1562B 参数 Datasheet PDF下载

    ICS1562B图片预览
    型号： ICS1562B
    PDF下载： 下载PDF文件 查看货源
    内容描述： 用户可编程差分输出图形时钟发生器 [User Programmable Differential Output Graphics Clock Generator]
    分类和应用： 时钟发生器
    文件页数/大小： 20 页 / 287 K
    品牌： ICS [ INTEGRATED CIRCUIT SYSTEMS ]
     浏览型号ICS1562B的Datasheet PDF文件第2页浏览型号ICS1562B的Datasheet PDF文件第3页浏览型号ICS1562B的Datasheet PDF文件第4页浏览型号ICS1562B的Datasheet PDF文件第5页浏览型号ICS1562B的Datasheet PDF文件第7页浏览型号ICS1562B的Datasheet PDF文件第8页浏览型号ICS1562B的Datasheet PDF文件第9页浏览型号ICS1562B的Datasheet PDF文件第10页  
    ICS1562B
    VCO增益
    4
    5
    6
    7
    最大频率
    120兆赫
    200兆赫
    260兆赫
    *
    电源和解耦
    该
    ICS1562B
    有两个VSS端子，以减少的效果
    封装电感。两个引脚都连接到相同的
    潜在的管芯（接地母线） 。两者兼有这些引脚
    应该连接到视频板的接地层接近
    到包是可能的。
    该
    ICS1562B
    具有VDDO销这是5伏电源
    电源所有输出驱动器。该引脚应连接到
    电源平面（或总线），使用标准的高频decou-
    耦做法。也就是说，电容应具有低串联电感
    tance并安装在靠近
    ICS1562B.
    VDD引脚是电源引脚的PLL合成器
    电路和其他较低的电流数字功能。 。我们建议
    修补的RC退耦或齐纳调节提供了
    此销（如图中建议的应用电路） 。
    这将允许PLL来“跟踪”，通过电源
    波动没有明显的影响。参见图6为典型
    外部电路。
    *特殊应用。联系厂方上述定制产品
    260兆赫。
    •
    鉴相器增益：对于大多数图形应用程序和
    分频器的范围，设定P [ 1,0 ] = 10和集合P [2] = 1。在
    某些情况下，设定为P [2]位“上的”能降低
    抖动。在1562处运行的确切倍数
    晶振频率， P [ 2 ]位= 0可以提供最佳的抖动
    性能。
    电路板测试支持
    通常期望以静态控制输出的电平
    引脚电路板测试。该
    ICS1562B
    通过支持该
    寄存器编程模式， AUXEN 。当该模式是
    设置两个寄存器位直接控制的逻辑电平
    CLK + / CLK-引脚和LOAD引脚。这个模式被激活
    当S [ 0]和S [ 1 ]位均设置为逻辑1。请参阅注册
    映射的详细信息。
    图6
    6

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