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WM8945 参数 Datasheet PDF下载

WM8945图片预览
型号: WM8945
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内容描述: 单声道低功耗编解码器与视频缓冲器和触摸屏控制器 [Mono Low-Power CODEC with Video Buffer and Touch Panel Controller]
分类和应用: 解码器编解码器控制器
文件页数/大小: 169 页 / 1604 K
品牌: WOLFSON [ WOLFSON MICROELECTRONICS PLC ]
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Production Data  
WM8945  
REG  
NAME  
15  
14  
13  
12  
11  
10  
9
8
7
6
5
4
3
2
1
0
DEFAULT  
AMP  
T
Left DAC digital Vol  
ADC Control 1  
R23 (17h)  
R25 (19h)  
0
0
0
0
0
0
DAC_  
VU  
0
0
0
0
0
0
DACL_  
MUTE  
DACL_VOL[7:0]  
00C0h  
0
ADC_  
MUTE  
ALL  
0
0
0
0
0
0
0
0
0
0
0
0
ADCL_ 0100h  
DATIN  
V
ADC Control 2  
R26 (1Ah)  
R27 (1Bh)  
R29 (1Dh)  
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
ADC_HPF_CU ADC_  
0000h  
00C0h  
000Fh  
T[1:0]  
HPF  
Left ADC Digital Vol  
DRC Control 1  
ADC_  
VU  
ADCL_  
MUTE  
ADCL_VOL[7:0]  
0
DRC_ DRC_  
NG_E ENA  
NA  
0
0
0
1
0
1
DRC_ DRC_  
QR ANTIC  
LIP  
1
DRC Control 2  
R30 (1Eh)  
0
0
0
DRC_NG_MINGAIN[3:0]  
0
0
DRC_MINGAIN[2:0] DRC_MAXGAI  
N[1:0]  
0C25h  
DRC Control 3  
DRC Control 4  
DRC Control 5  
R31 (1Fh)  
R32 (20h)  
R33 (21h)  
0
0
0
0
0
0
0
0
0
0
0
1
1
DRC_ATK[3:0]  
DRC_KNEE_IP[5:0]  
DRC_KNEE_OP[4:0]  
DRC_DCY[3:0]  
0342h  
0000h  
0003h  
DRC_KNEE2_IP[4:0]  
DRC_KNEE2_OP[4:0]  
0
0
DRC_  
KNEE2  
_OP_E  
NA  
DRC_HI_COMP[2:0]  
DRC Control 6  
DRC Control 7  
R34 (22h)  
R35 (23h)  
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
DRC_QR_THR[ DRC_QR_DCY  
0000h  
0000h  
0000h  
1:0]  
[1:0]  
0
DRC_NG_EXP[ DRC_LO_COMP[2:0]  
1:0]  
DRC_INIT[4:0]  
DRC Status  
R36 (24h)  
R37 (25h)  
DRC_GAIN[15:0]  
Beep Control 1  
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
BEEP_GAIN[3:0]  
BEEP_RATE[1: BEEP_ 0002h  
0] ENA  
Video Buffer  
Input ctrl  
R38 (26h)  
R39 (27h)  
0
VB_EN VB_Q VB_G  
VB_DISOFF[2:0]  
VB_PD VB_CL 001Ch  
AMP  
A
BOOS AIN  
T
0
0
0
0
0
0
0
0
0
0
0
AUX2_ AUX1_ MICB_  
AUDIO AUDIO LVL  
1
MICLN  
0
1
P_PGAL_SEL[  
1:0]  
0035h  
_TO_N  
_PGAL  
Left INP PGA gain  
ctrl  
R40 (28h)  
R42 (2Ah)  
0
0
0
0
0
1
PGA_ PGAL_ PGAL_  
PGAL_VOL[5:0]  
0050h  
8300h  
VU  
ZC MUTE  
Output ctrl  
THER  
SPKR_ SPKL_  
VMID_ VMID_  
OP_E OP_E  
LINEL  
_VMID  
_OP_E  
NA  
LINEL SPKR_ SPKL_  
_MUT DISCH DISCH  
E
0
LINEL  
_DISC  
H
0
0
SPK_V LINE_  
ROI VROI  
R_ACT  
NA  
NA  
SPK mixer control1  
SPK mixer control2  
SPK mixer control3  
R43 (2Bh)  
R44 (2Ch)  
R45 (2Dh)  
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
0
AUX1_ PGAL_ BYPL_ MDAC  
TO_SP TO_SP TO_P L_TO_  
0
0
0
DACL_  
TO_P  
GAL  
0
0
0
AUX2_ AUX1_ 0000h  
TO_P TO_P  
KL  
KL  
GAL PGAL  
GAL GAL  
0
0
0
0
AUX1_ PGAR  
TO_SP _TO_S  
0
MDAC  
L_TO_  
PGAR  
DACL_  
TO_P  
GAR  
AUX2_ AUX1_ 0000h  
TO_P TO_P  
KR  
PKR  
GAR GAR  
AUX1_ PGAL_ BYPL_  
TO_SP TO_SP TO_P  
KL_AT KL_AT GAL_A  
TEN TEN TTEN  
0
DACL_  
TO_P  
AUX2_ AUX1_ 0000h  
TO_P TO_P  
GAL_A  
TTEN  
GAL_A GAL_A  
TTEN TTEN  
SPK mixer control4  
Left SPK volume ctrl  
R46 (2Eh)  
0
0
0
0
0
0
0
AUX1_ PGAR  
TO_SP _TO_S  
KR_AT PKR_A  
TEN TTEN  
0
0
0
DACL_  
TO_P  
0
AUX2_ AUX1_ 0000h  
TO_P TO_P  
GAR_  
ATTEN  
GAR_ GAR_  
ATTEN ATTEN  
R47 (2Fh)  
R48 (30h)  
0
0
0
0
0
0
0
0
0
0
0
0
0
0
SPK_V SPKL_ SPKL_  
SPKL_VOL[5:0]  
SPKR_VOL[5:0]  
0079h  
0079h  
U
ZC PGA_  
MUTE  
Right SPK volume  
ctrl  
SPK_V SPKR_ SPKR_  
U
ZC PGA_  
MUTE  
PD, May 2011, Rev 4.1  
109  
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