欢迎访问ic37.com |
会员登录 免费注册
发布采购

78P2342JAT-IGT 参数 Datasheet PDF下载

78P2342JAT-IGT图片预览
型号: 78P2342JAT-IGT
PDF下载: 下载PDF文件 查看货源
内容描述: [PCM Transceiver, 1-Func, PQFP100, LQFP-100]
分类和应用: PC电信电信集成电路
文件页数/大小: 36 页 / 366 K
品牌: TDK [ TDK ELECTRONICS ]
 浏览型号78P2342JAT-IGT的Datasheet PDF文件第3页浏览型号78P2342JAT-IGT的Datasheet PDF文件第4页浏览型号78P2342JAT-IGT的Datasheet PDF文件第5页浏览型号78P2342JAT-IGT的Datasheet PDF文件第6页浏览型号78P2342JAT-IGT的Datasheet PDF文件第8页浏览型号78P2342JAT-IGT的Datasheet PDF文件第9页浏览型号78P2342JAT-IGT的Datasheet PDF文件第10页浏览型号78P2342JAT-IGT的Datasheet PDF文件第11页  
78P2342JAT  
2-port E3/DS3/STS-1 LIU  
with Jitter Attenuator  
REGISTER DESCRIPTION  
REGISTER ADDRESSING  
Address Bits  
Bit 7  
Bit 6  
Bit 5  
Bit 4  
Bit 3  
Bit 2  
Sub-Address  
SA[1]  
Bit 1  
Bit 0  
Read/  
Write  
Port Address  
Assignment  
PA[3]  
PA[2]  
PA[1]  
PA[0]  
SA[2]  
SA[0]  
R/W*  
REGISTER TABLE  
a) PA[3:0] = 0 : Global Registers  
Reg.  
Sub  
Description  
Master Control  
Interrupt Control  
Bit 7  
Bit 6  
Bit 5  
Bit 4  
ENDEC  
<0>  
Bit 3  
Bit 2  
Bit 1  
Bit 0  
Addr  
Name  
REGEN  
<0>  
INPOL  
<0>  
E3  
<X>  
RCLKP  
<0>  
JAFLG  
<0>  
TCLKP  
<0>  
JAER  
<0>  
SRST  
<0>  
MSCR  
DS3  
<X>  
0
1
--  
(R/W)  
INTC  
RXER  
<1>  
TXER  
--  
--  
--  
(R/W)  
<1>  
2
3
4
5
6
7
RSVD  
RSVD  
RSVD  
RSVD  
RSVD  
RSVD  
Reserved  
Reserved  
Reserved  
Reserved  
Reserved  
Reserved  
--  
<0>  
--  
--  
<0>  
--  
--  
<0>  
--  
--  
<0>  
--  
--  
<0>  
--  
--  
<0>  
--  
--  
<0>  
--  
--  
<0>  
--  
--  
--  
--  
--  
--  
--  
--  
--  
<0>  
<0>  
<0>  
<0>  
<0>  
<0>  
<0>  
<0>  
<0>  
<0>  
<0>  
<0>  
<0>  
<0>  
<0>  
<0>  
b) PA[3:0] = 1-2 : Port-Specific Registers  
Reg.  
Name  
Sub  
Description  
Bit 7  
Bit 6  
Bit 5  
Bit 4  
Bit 3  
Bit 2  
Bit 1  
Bit 0  
Addr  
MDCR  
PDTX  
<0>  
PDRX  
<0>  
LBO  
<1>  
LLBKA  
<0>  
LLBKB  
<0>  
RLBK  
<0>  
MON  
<0>  
TXEN  
<1>  
0
Mode Control  
(R/W)  
STAT  
(R/O)  
RSVD  
JACR  
(R/W)  
--  
--  
--  
1
2
3
Status Monitor  
Reserved  
FERR  
LOS  
TXNW  
--  
SGLO  
<1>  
JAEN  
<X>  
<1>  
<0>  
<1>  
<0>  
<0>  
ESP[1]  
<1>  
<1>  
ESP[0]  
<1>  
<0>  
<0>  
<0>  
JABW  
<X>  
Jitter Attenuator  
JASL  
JLBK  
<X>  
<0>  
Control  
4
5
6
7
RSVD  
RSVD  
RSVD  
RSVD  
Reserved  
Reserved  
Reserved  
Reserved  
--  
--  
--  
--  
--  
--  
--  
--  
--  
--  
<0>  
--  
<0>  
--  
<0>  
--  
<0>  
--  
<0>  
--  
<0>  
--  
--  
--  
<0>  
<0>  
<0>  
<0>  
<0>  
<0>  
<0>  
<0>  
Note: Shaded registers in Register Table are reserved for TDK internal use only. Accessing reserved or  
undefined registers may cause undesirable operation.  
- 7 -