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5CGTFD9E5F31C7N 参数 Datasheet PDF下载

5CGTFD9E5F31C7N图片预览
型号: 5CGTFD9E5F31C7N
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内容描述: [Field Programmable Gate Array, 301000-Cell, CMOS, PBGA896, ROHS COMPLIANT, FBGA-896]
分类和应用: 可编程逻辑
文件页数/大小: 95 页 / 1359 K
品牌: INTEL [ INTEL ]
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CV-51002  
2015.12.04  
21  
Differential HSTL and HSUL I/O Standards  
VSWING(AC) (V)  
VCCIO (V)  
Typ  
VSWING(DC) (V)  
VX(AC) (V)  
Typ  
I/O Standard  
Min  
Max  
Min  
Max  
Min  
Max  
Min  
Max  
(20)  
SSTL-125  
1.19  
1.25  
1.31  
0.18  
VCCIO/2 –  
0.15  
VCCIO/2  
VCCIO/2 +  
0.15  
2(VIH(AC)  
2(VIL(AC) – VREF)  
VREF  
)
Differential HSTL and HSUL I/O Standards  
Table 18: Differential HSTL and HSUL I/O Standards for Cyclone V Devices  
VCCIO (V)  
Typ  
VDIF(DC) (V)  
VX(AC) (V)  
Typ  
VCM(DC) (V)  
VDIF(AC) (V)  
I/O Standard  
Min  
Max  
Min  
Max  
Min  
Max  
Min  
Typ  
Max  
Min  
Max  
HSTL-18 1.71  
Class I, II  
1.8  
1.89  
0.2  
0.78  
1.12  
0.9  
0.78  
1.12  
0.4  
HSTL-15 1.425  
Class I, II  
1.5  
1.2  
1.2  
1.575  
1.26  
1.3  
0.2  
0.68  
0.68  
0.9  
0.4  
0.3  
HSTL-12 1.14  
Class I, II  
0.16  
0.26  
VCCIO  
0.3  
+
0.5 ×  
0.4 ×  
0.5 ×  
0.6 ×  
VCCIO + 0.48  
0.44  
VCCIO  
VCCIO  
VCCIO  
VCCIO  
HSUL-12 1.14  
0.26  
0.5 ×  
VCCIO  
0.12  
0.5 ×  
0.5 ×  
VCCIO  
0.12  
0.4 ×  
0.5 ×  
0.6 ×  
0.44  
VCCIO  
+
VCCIO  
VCCIO  
VCCIO  
Cyclone V Device Datasheet  
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