A32100DX-CQ84B 参数 Datasheet PDF下载

HiRel FPGAs

Dual-Port SRAM Timing Waveforms

3200DX SRAM Write Operation

t_RCKHL

WCLK

t_ADSU

t_ADH

WD[7:0]

WRAD[5:0]

Valid

t_WENSU

t_WENH

WEN

t_BENSU

Valid

t_BENH

BLKEN

Note: Identical timing for falling-edge clock.

3200DX SRAM Synchronous Read Operation

t_CKHL

t_RCKHL

RCLK

t_RENSU

t_RENH

REN

t_ADSU

Valid

t_ADH

RDAD[5:0]

t_RCO

t_DOH

Old Data

New Data

RD[7:0]

Note: Identical timing for falling-edge clock.

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