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    VS1005 参数 Datasheet PDF下载

    VS1005图片预览
    型号： VS1005
    PDF下载： 下载PDF文件 查看货源
    内容描述： 此产品是芬兰VLSI刚刚研发成功的音频编解码芯片样品 [此产品是芬兰VLSI刚刚研发成功的音频编解码芯片样品]
    分类和应用：
    文件页数/大小： 104 页 / 1715 K
    品牌： ETC [ ETC ]
     浏览型号VS1005的Datasheet PDF文件第1页浏览型号VS1005的Datasheet PDF文件第2页浏览型号VS1005的Datasheet PDF文件第4页浏览型号VS1005的Datasheet PDF文件第5页浏览型号VS1005的Datasheet PDF文件第6页浏览型号VS1005的Datasheet PDF文件第7页浏览型号VS1005的Datasheet PDF文件第8页浏览型号VS1005的Datasheet PDF文件第9页  
    VS1005g Datasheet
    7.1.3
    7.2
    CONTENTS
    22
    Digital Section . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
    Analog Section . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
    9 Firmware Operation
    9.1
    9.2
    9.3
    9.4
    SPI Boot . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
    NAND FLASH Probe . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
    UART Boot/Monitor . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
    Default Firmware Features . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
    9.4.1
    9.4.2
    USB Mass Storage and Audio Device . . . . . . . . . . . . . . . . . .
    Default Player Application . . . . . . . . . . . . . . . . . . . . . . . .
    9.5
    Supported Audio Codecs . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
    9.5.1
    Supported MP3 (MPEG layer III) Formats . . . . . . . . . . . . . . .
    10 VS1005 Peripherals and Registers
    10.1 The Processor Core
    PR
    EL
    IM
    Version: 0.2, 2012-03-16
    . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
    10.2 VS1005 Memory Map . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
    10.3 VS1005 Peripherals . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
    10.4 Interrupt Controller . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
    10.4.1 Interrupt Controller Registers . . . . . . . . . . . . . . . . . . . . . .
    10.4.2 Enable INT_ENABLE[L/H][0/1] . . . . . . . . . . . . . . . . . . . . . .
    10.4.3 Origin INT_ORIGIN[0/1] . . . . . . . . . . . . . . . . . . . . . . . . .
    10.4.4 Vector INT_VECTOR . . . . . . . . . . . . . . . . . . . . . . . . . . .
    10.4.5 Enable Counter INT_ENCOUNT . . . . . . . . . . . . . . . . . . . . .
    10.4.6 Global Disable INT_GLOB_DIS . . . . . . . . . . . . . . . . . . . . .
    10.4.7 Global Enable INT_GLOB_EN . . . . . . . . . . . . . . . . . . . . . .
    10.5 DSP Clock Domain Registers . . . . . . . . . . . . . . . . . . . . . . . . . . . .
    10.5.1 General Purpose Software Registers . . . . . . . . . . . . . . . . . .
    10.5.2 Peripheral IO control . . . . . . . . . . . . . . . . . . . . . . . . . . .
    10.5.3 PLL clock control . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
    IN
    AR
    26
    26
    27
    28
    29
    29
    29
    31
    31
    32
    32
    32
    33
    34
    35
    35
    35
    36
    36
    36
    36
    37
    37
    37
    37
    3
    8 Oscillator and Reset Configuration
    Y
    24
    25

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