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TMS320VC5407-120 参数 Datasheet PDF下载

TMS320VC5407-120图片预览
型号: TMS320VC5407-120
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内容描述: 数字信号处理器\n [Digital Signal Processor ]
分类和应用: 数字信号处理器
文件页数/大小: 107 页 / 1343 K
品牌: ETC [ ETC ]
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功能概述
4位
:该位是间隔中断( BI )的指标。当BI被设置,它表示接收到的数据输入
在保持低比全字的传输时间。一个全字的传输时间被定义为
总时间发送起始位,数据,奇偶校验位和停止位。 BI是每次清除CPU读取的内容
在LSR的。在FIFO模式下,该错误与特定字符在FIFO相关联,它
适用。这个错误被发现时向CPU及其相关联的字符是在FIFO的顶部。当一个
断点发生时,只有一个0字符被加载到FIFO 。单之后的下一个字符传送启用
进到用于至少两个RCLK样品的标记状态,然后接收下一个有效的起始位。
位5:该位是THRE指示器。当THR是空的,表明UART准备THRE设置
接受一个新的字符。如果THRE中断使能时, THRE置位,产生一个中断。
当THR的内容被传输到TSR THRE设置。 THRE被清除并发的
加载THR由CPU的。在FIFO模式中, THRE是当发送FIFO为空集;它被清零
当至少有一个字节被写入发送FIFO。
第6位:该位是发送器空( TEMT )指标。 TEMT位被置位时, THR和TSR是
同时为空。当任一THR或TSR包含一个数据字符, TEMT清零。在FIFO模式下,
TEMT设置当发送FIFO和移位寄存器均为空。
第7位:在TL16C550C模式下,该位总是被清零。在TL16C450模式下,该位总是被清零。
在FIFO模式, LSR7是当存在至少一个奇偶校验,成帧或在FIFO打破错误设定。这是
清零时,微处理器读取LSR和有在FIFO中不再出现差错。
3.13.9
调制解调器控制寄存器( MCR )
在MCR是一个8位寄存器,用于控制与一个调制解调器,数据集或外围设备的接口。在UART
周中,只有一个位激活该寄存器中
第4位:该位( LOOP )提供了UART的诊断测试本地环回功能。当LOOP
设置,将发生以下情况:
发射机SOUT被设置为高。
接收器SIN断开。
在TSR的输出被回送到接收移位寄存器的输入。
3.13.10可编程的波特率发生器
该UART包括一个可编程的波特率发生器,它接受一个时钟输入的DC之间的范围
16兆赫和通过在范围为1和(2之间的除数将其划分
16
-1) 。波特的输出频率
发电机是16倍( 16
×)
波特率。通式为除数为:
除数= XIN频率输入
÷
(所需的波特率
×
16)
两个8位寄存器,称为除数锁存器,存储所述除数在一个16位的二进制格式。这些除数锁存器必须
为了确保波特率发生器的所希望的操作在UART的初始化期间被加载。当
任一的除数锁存器被加载时,一个16位的波特率计数器也加载,以防止在初始负荷长计数。
表3-20和表3-21示出了利用波特率发生器用的1.8432兆赫的时钟频率和
分别为3.072兆赫。对于波特率38.4千位/秒以下,是获得的误差非常小。精度
所选波特率的是取决于所选择的时钟频率。
‡位1至4是产生一个接收线路状态中断的错误状态。
2001年11月 - 修订2003年7月
SPRS007B
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