Vitesse公司
半导体公司
500 Mb / s的视频
移位寄存器IC
初步数据表
VSC6424
HBLANK
or
VBLANK
所需的前两个时钟周期必须被驱动为低电平的至少一个时钟周期
点消隐。参见图6,用于该功能的时序图。
重定时器
该芯片还包含一个重定时器功能。此功能在
解复用
模式。该
重定时
信号
路由到
DOUT<7>
通过一个触发器。触发器内部时钟由低速ECL输出时钟
( CLKE ) 。这个功能被描述在下面的详细方框图(图3) 。参见图5的时序
插图。
图2 :多路复用器的详细结构图
O
EN
0㞒
Ø ê
AEN /重定时
A<0 : 4>
HBLANK
VBLANK
CLKE
重定时器
DOUT<7>
S<0 : 2>
7
40
8
MUX
产量
LATCH
8
DOUT<0 : 6>
高
速度
接口
( ECL)的
O
PS
C
LK
CLKOUT
终止
建议把所有未使用的ECL输出浮动。建议将未使用的ECL投入是
终止低( -2V电源) 。请参考下表推荐的输入端接各级。
表4 :输入端接建议
TYPE
ECL
ECL
TTL
TTL
状态
高
低
高
低
输入
通过二极管接地
-2V供应
+ 3.3V电源
地
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G52236-0 ,版本3.0
7/13/99