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    LAN7500-ABZJ 参数 Datasheet PDF下载

    LAN7500-ABZJ图片预览
    型号： LAN7500-ABZJ
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    内容描述： [Serial I/O Controller, 0 Channel(s), 60MBps, CMOS, 8 X 8 MM, ROHS COMPLIANT, QFN-56]
    分类和应用： 通信时钟数据传输外围集成电路
    文件页数/大小： 56 页 / 616 K
    品牌： SMSC [ SMSC CORPORATION ]
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    Hi-Speed USB 2.0 to 10/100/1000 Ethernet Controller  
    Datasheet  
    7.5.4  
    Reset Timing  
    Figure 7.3 illustrates the nRESET pin timing requirements. When used, nRESET must be asserted for  
    no less than trstia  
    .
    Note: A hardware reset (nRESET assertion) is required following power-on. Refer to Section 7.5.3,  
    "Power-On Reset Timing," on page 49 for additional information.  
    trstia  
    nRESET  
    Figure 7.4 nRESET Timing  
    Table 7.17 nRESET Timing Values  
    SYMBOL  
    DESCRIPTION  
    nRESET input assertion time  
    MIN  
    TYP  
    MAX  
    UNITS  
    trstia  
    1
    μS  
    Revision 1.0 (11-01-10)  
    SMSC LAN7500/LAN7500i  
    DATA5S0HEET  

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