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PE33241 参数 Datasheet PDF下载

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型号: PE33241
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内容描述: 的UltraCMOS整数N分频PLL频率合成器的低相位噪声应用 [UltraCMOS Integer-N PLL Frequency Synthesizer for Low Phase Noise Applications]
分类和应用:
文件页数/大小: 13 页 / 466 K
品牌: PSEMI [ Peregrine Semiconductor ]
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PE33241
初步speci fi cation
串行接口模式
而E_WR输入为“低”和S_WR
输入为“低” ,串行输入数据( SDATA输入) ,乙
0
to
B
20
,是串行时钟到主寄存器上
SCLK, MSB( B的上升沿
0
)第一。该
从主寄存器的内容被传输
入上的上升沿二次寄存器
S_WR根据时序图中示出
图5中。
数据传送到柜台
所示
表7中。
而E_WR输入为“高”和S_WR
输入为“低” ,串行输入数据( SDATA输入) ,乙
0
to
B
7
,计时串联到该增强
在SCLK , MSB的上升沿寄存器(B
0
)第一。
增强的寄存器是双缓冲来
防止在无意中串行控制的变化
装载,用的串联输入缓冲器捕获
上E_WR的下降沿进行数据
根据所示的时序图
图5中。
E_WR的下降沿之后,将数据提供
控制比特,如图
表8
有位功能
通过断言使能
ENH
输入“低” 。
直接接口模式
直接接口模式,可通过设置
直接输入“高” 。
计数器控制位直接在引脚设置
所示
表7
表8 。
表7.初级寄存器编程
接口
模式
串行*
直接
ENH
1
1
R
5
B
0
R
5
R
4
B
1
R
4
M
8
B
2
M
8
M
7
B
3
M
7
PRE_EN
B
4
M
6
B
5
M
6
M
5
B
6
M
5
M
4
B
7
M
4
M
3
B
8
M
3
M
2
B
9
M
2
M
1
B
10
M
1
M
0
B
11
M
0
R
3
B
12
R
3
R
2
B
13
R
2
R
1
B
14
R
1
R
0
B
15
R
0
A
3
B
16
A
3
A
2
B
17
A
2
A
1
B
18
A
1
A
0
B
19
A
0
ADDR
B
20
0
PRE_EN
*串行数据串行时钟在SCLK的上升沿时E_WR “低”和S_WR上升沿二次捕获寄存器
MSB (第一)
(后进) LSB
表8.增强寄存器编程
接口
模式
串行*
ENH
0
直接
0
版权所有
B
0
版权所有
B
1
f
p
产量
B
2
动力
B
3
计数器
负载
B
4
MSEL
产量
B
5
f
c
产量
B
6
LD禁用
B
7
*串行数据串行时钟在SCLK的上升沿时E_WR “高”,抓获在E_WR下降沿双缓冲。
MSB (第一)
(后进) LSB
文件编号DOC- 15014-3
www.psemi.com
©2010-2013 Peregrine半导体公司保留所有权利。
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