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L4C383JC20 参数 Datasheet PDF下载

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型号: L4C383JC20
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内容描述: 16位级联ALU (扩展集) [16-bit Cascadable ALU (Extended Set)]
分类和应用:
文件页数/大小: 11 页 / 85 K
品牌: LOGIC [ LOGIC DEVICES INCORPORATED ]
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L4C383  
DEVICES INCORPORATED  
16-bit Cascadable ALU (Extended Set)  
SWITCHING CHARACTERISTICS — MILITARY OPERATING RANGE (–55°C to +125°C)  
GUARANTEED MAXIMUM COMBINATIONAL DELAYS Notes 9, 10 (ns)  
*
*
*
L4C383-30  
To Output  
L4C383-65  
L4C383-45  
From Input  
F15-F0  
N
OVF, Z C16 F15-F0  
N
OVF, Z C16 F15-F0  
N
OVF, Z C16  
FTAB = 0, FTF = 0  
Clock  
C0  
37  
44  
48  
63  
42  
48  
45  
25  
48  
28  
34  
38  
50  
32  
38  
34  
23  
38  
26  
28  
28  
34  
22  
28  
28  
22  
28  
S4-S0  
FTAB = 0, FTF = 1  
Clock  
C0  
68  
42  
66  
44  
48  
63  
42  
48  
45  
25  
48  
56  
32  
46  
34  
38  
50  
32  
38  
34  
23  
38  
34  
26  
30  
28  
28  
34  
22  
28  
28  
22  
28  
S4-S0  
FTAB = 1, FTF = 0  
A15-A0, B15-B0  
Clock  
37  
44  
48  
56  
42  
48  
44  
25  
48  
28  
32  
38  
46  
32  
38  
36  
23  
38  
26  
28  
28  
28  
22  
28  
28  
22  
28  
C0  
S4-S0  
FTAB = 1, FTF = 1  
A15-A0, B15-B0  
Clock  
65  
68  
42  
66  
44  
44  
48  
56  
63  
42  
48  
44  
45  
25  
48  
45  
56  
32  
46  
32  
34  
38  
46  
50  
32  
38  
36  
34  
23  
38  
30  
34  
26  
30  
28  
28  
28  
28  
34  
22  
28  
28  
28  
22  
28  
C0  
S4-S0  
GUARANTEED MINIMUM SETUP AND HOLD TIMES WITH RESPECT TO CLOCK RISING EDGE Notes 9, 10 (ns)  
*
*
*
L4C383-65  
FTAB = 0 FTAB = 1  
Setup Hold Setup Hold Setup Hold Setup Hold Setup Hold Setup Hold  
L4C383-45  
L4C383-30  
FTAB = 0 FTAB = 1  
FTAB = 0 FTAB = 1  
Input  
A15-A0, B15-B0  
C0  
10  
25  
50  
12  
3
0
0
2
43  
25  
50  
12  
3
0
0
2
8
3
0
0
2
33  
20  
36  
10  
3
0
0
2
8
3
0
0
2
20  
12  
20  
10  
3
0
0
2
20  
36  
10  
12  
20  
10  
S4-S0  
ENA, ENB, ENF  
TRI-STATE ENABLE/DISABLE TIMES Notes 9, 10, 11 (ns)  
CLOCK CYCLE TIME AND PULSE WIDTH Notes 9, 10 (ns)  
*
*
*
*
*
*
L4C383-30  
L4C383-65  
L4C383-45  
L4C383-30  
L4C383-65  
L4C383-45  
Minimum Cycle Time  
Highgoing Pulse  
Lowgoing Pulse  
tENA  
tDIS  
22  
22  
20  
20  
18  
18  
52  
20  
20  
38  
15  
15  
26  
12  
12  
*DISCONTINUED SPEED GRADE  
Arithmetic Logic Units  
08/16/2000–LDS.383-E  
8