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ICS1523MLF 参数 Datasheet PDF下载

ICS1523MLF图片预览
型号: ICS1523MLF
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内容描述: 视频时钟合成器,带有I2C可编程延迟 [Video Clock Synthesizer with I2C Programmable Delay]
分类和应用: 时钟
文件页数/大小: 21 页 / 461 K
品牌: ICS [ INTEGRATED CIRCUIT SYSTEMS ]
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ICS1523
视频时钟合成器与我
2
C可编程延迟
第2节
1
2
3
4
5
6
7
8
9
10
11
12
13
引脚说明
TYPE
动力
动力
IN / OUT
IN
IN
IN
IN
IN
IN
动力
动力
IN
IN
描述
数字电源
数字地
串行数据
串行时钟
电荷泵启用
在外部反馈
水平同步
外部滤波器
外部滤波器的回报
模拟电源
模拟地
振荡器
I
2
C类地址
I
2
C- bus数据
I
2
C总线时钟
启用\\禁用电荷泵
外部反馈分频器输入
时钟输入到PLL
外部环路滤波器
外部环路滤波器的回报
3.3 V的模拟电路
地面模拟电路
投入振荡器或其他高
频率输入
芯片的I
2
C类地址选择
低= 4DH读,写4通道
高= 4FH读,写4EH
REF (施密特空调HSYNC )或
PLL锁定输出
4时钟输出之间选择
宽,高有效HSYNC般的输出,
和施密特触发器滤波HSYNC
输出驱动器为半速时钟
输出驱动器全速时钟
3.3 V输出驱动器
接地输出驱动器
PECL驱动器全速时钟
PECL驱动半速时钟
参考电流PECL输出
1&2
1
1
1
1
1
评论
3.3 V至数字部分
笔记
引脚名称
VDDD
VSSD
SDA
SCL
COAST
EXTFB
HSYNC
EXTFIL
XFILRET
VDDA
VSSA
OSC
I
2
CADR
14
15
LOCK / REF
FUNC
SSTL
_
3 OUT
SSTL
_
3 OUT
锁定/参考
功能输出
16
17
18
19
20
21
22
23
24
CLK/2
CLK
VDDQ
VSSQ
CLK “
CLK +
CLK/2–
CLK/2+
IREF
SSTL
_
3 OUT
SSTL
_
3 OUT
动力
动力
OD OUT
OD OUT
IN
像素时钟/ 2输出
像素时钟输出
输出驱动器电源
输出驱动器地
像素时钟输出
像素时钟/ 2输出
参考电流
注1:这些LVTTL输入是可承受5V电压。
注2 :如果连接到未使用的接地。
MDS 1523 ÿ
集成电路系统
4
525马街,圣何塞,加利福尼亚95126
电话:( 408 ) 297-1201
修订版110905
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