ICS1522 参数 Datasheet PDF下载

型号：	ICS1522
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内容描述：	用户可编程的视频时钟发生器/行同步时钟再生 [User-Programmable Video Clock Generator/ Line-Locked Clock Regenerator]
分类和应用：	时钟发生器
文件页数/大小：	13 页 / 366 K
品牌：	ICS [ INTEGRATED CIRCUIT SYSTEMS ]

ICS1522

输出说明

差分输出驱动器，

CLK +

和

CLK- ，

是

电流模式，并用于驱动电阻端接

以互补的方式。的输出是电流 -

只沉没，与灌电流可编程的量

通过

IPRG

引脚。吸收电流，从而被导向

或

CLK +

CLK- ，

在当前的四倍供给

该

IPRG

引脚。对于大多数应用来说，从VDDO电阻

到IPRG将电流设置为所需的精度。

参考振荡器和

晶体的选择

该

ICS1522

有电路板上实现皮尔斯

振荡器与除石英晶体和2的

外部负载电容（ EXTREF位必须设置为

逻辑0 ）。皮尔斯振荡器工作在晶体中抗（也

所谓并联）谐振模式。

串联谐振的晶体，也可以与所使用的

ICS1522.

要知道，振荡频率会稍微

比印在罐频率越高

（典型地0.025-0.05 ％）。

作为锁相环的整个操作取决于

在具有稳定的参考频率，我们建议

该晶体可作为紧密地安装尽可能地

封装。避免路由数字信号或

ICS1522

下面或附近的这些痕迹输出。还期望

如果可能的接地晶体罐到接地平面。

如果外部基准频率源是能够与使用

该

ICS1522,

它是无抖动是重要的。上升

和下降该信号的边缘应该是快速和免费的

噪声以获得最佳效果。环路相位被锁定到崛起

在XTAL1 / EXTREF输入信号的上升沿，如果REF_POL是

设置为逻辑0。此外， EXTREF位应设置

为逻辑1的TTL兼容的缓冲液，在此切换

输入。

行锁定操作

一些视频应用需要一个时钟，以生成

这是水平同步的倍数。该

ICS1522

支持这种操作模式。参考分频器

应设置一个与所期望的极性分

锁边（上升或下降）应该被选中。通过

采用相位检测硬件禁用模式（ PDEN ）

该PLL可以向自由运行时的开始

外部视频的垂直间隔，并且可以是

重新在其完成。

外部反馈操作

该

ICS1522

选项还支持列入的

外部计数器PLL的反馈分频器。

这种模式在图形系统必须是有用的

“同步锁定”外部视频源。

当FBK_SEL位被置为逻辑0时，相位

频率检测器将使用

EXTFBK

引脚作为其

反馈输入。环路相位将被锁定到

信号的上升沿施加到EXTFBK输入

如果FBK_POL被设置为逻辑0同步切换

在内部反馈，可交complished通过

设置FBK -SEL位为逻辑1，而活跃

反馈源存在于EXTFBK引脚。

24引脚SOIC

精细调整阶段

该

ICS1522

具有调整的像素的能力

时钟相位相对于输入参考相位。

整个像素可以添加或根据名册中删除

与子像素调整，换货的控制来实现由

控制电压上的FINE输入引脚。通过利用该

精细调整阶段后，第一个同步开关

从外部反馈到内部反馈，图形

系统相可以精确地控制相对

输入的水平同步。

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