EDJ1108BABG-AC-E 参数 Datasheet PDF下载

EDJ1108BABG, EDJ1116BABG

T10 T11 T12

/CK

0 to 2

Address

(A0 to A9)

3FF

000

3FF

0 0 0

Address

(A10)

Address

(A11 to A12)

0 0

/CS

/RAS

/CAS

/WE

Command

0 to 2

READ

00 00 FF FF 00 00 FF FF 00 00 FF FF 00 00 FF FF

0 to 7

Start of measurement loop

IDD4R Example* (DDR3-800-555, 512Mb ×8)

Note: Data DQ is shown but the output buffer should be switched off (per MR1 bit A12 = 1) to achieve IOUT = 0mA.

Address inputs are split into 3 parts.

Data Sheet E1248E40 (Ver. 4.0)

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