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    CY7C68300A-56PVC 参数 Datasheet PDF下载

    CY7C68300A-56PVC图片预览
    型号： CY7C68300A-56PVC
    PDF下载： 下载PDF文件 查看货源
    内容描述： EZ- USB AT2⑩ USB 2.0到ATA / ATAPI桥 [EZ-USB AT2⑩ USB 2.0 To ATA/ATAPI Bridge]
    分类和应用： 总线控制器微控制器和处理器外围集成电路光电二极管时钟
    文件页数/大小： 21 页 / 491 K
    品牌： CYPRESS [ CYPRESS SEMICONDUCTOR ]
     浏览型号CY7C68300A-56PVC的Datasheet PDF文件第1页浏览型号CY7C68300A-56PVC的Datasheet PDF文件第2页浏览型号CY7C68300A-56PVC的Datasheet PDF文件第3页浏览型号CY7C68300A-56PVC的Datasheet PDF文件第5页浏览型号CY7C68300A-56PVC的Datasheet PDF文件第6页浏览型号CY7C68300A-56PVC的Datasheet PDF文件第7页浏览型号CY7C68300A-56PVC的Datasheet PDF文件第8页浏览型号CY7C68300A-56PVC的Datasheet PDF文件第9页  
    这部分是不推荐用于新设计
    使用CY7C68300B EZ -USB AT2LP ™ USB2.0到ATA / ATAPI
    桥新设计
    CY7C68300A
    引脚说明
    （续）
    SSOP QFN
    针
    引脚引脚名称
    11
    12
    13
    14
    15
    4
    5
    6
    7
    8
    XTALOUT
    XTALIN
    AGND
    V
    CC
    DPLUS
    针
    TYPE
    XTAL
    XTAL
    GND
    PWR
    I / O
    在启动时默认状态
    XTAL
    XTAL
    引脚说明
    24 MHz的晶振输出
    （参见3.2.3节） 。
    24 MHz的晶振输入
    （参见3.2.3节） 。
    模拟地。
    连接到地面尽可能短的路径
    可能。
    V
    CC
    。连接到3.3V电源。
    拉高时复位
    USB D +信号
    （参见3.2.1节） 。
    活跃的。当复位
    公布，上拉是
    通过引脚46 （ SSOP ）控制/
    39 （ QFN ） 。当VBUS_
    PWR_VALID为高时，线
    被拉起。 VBUS_PWR
    _VALID轮询在启动
    然后每隔20毫秒。
    高阻
    USB D-信号
    （参见3.2.1节） 。
    地面上。
    V
    CC
    。连接到3.3V电源。
    地面上。
    高阻
    绑10K ± 5 ％的上拉电阻。
    版权所有。
    绑到GND 。
    O
    I / O
    PWR
    I / O
    I / O
    I / O
    I / O
    I / O
    I / O
    I / O
    I / O
    GND
    PWR
    GND
    O / Z
    [1]
    O / Z
    [1]
    PWR
    I
    [1]
    输入
    驱动为高电平（ CMOS ）
    驱动为高电平（ CMOS ）
    高阻
    高阻
    高阻
    高阻
    高阻
    高阻
    高阻
    高阻
    SCL / SDA将活跃
    时钟信号我
    2
    C兼容接口
    （见
    几个ms启动时。然后， 3.2.2 ） 。
    驱动为高电平。
    因为我的数据信号
    2
    C兼容接口
    （参见3.2.2节） 。
    V
    CC
    。连接到3.3V电源。
    ATA数据位0 。
    ATA数据位1 。
    ATA数据位2 。
    ATA数据位3 。
    ATA数据位4 。
    ATA数据位5 。
    ATA数据位6 。
    ATA数据位7 。
    地面上。
    V
    CC
    。连接到3.3V电源。
    地面上。
    ATA控制。
    ATA控制。
    ATA控制。
    V
    CC
    。连接到3.3V电源。
    IDE ATA中断请求。
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    DMINUS
    GND
    V
    CC
    GND
    PU10K
    储备
    D
    SCL
    SDA
    V
    CC
    DD0
    DD1
    DD2
    DD3
    DD4
    DD5
    DD6
    DD7
    GND
    V
    CC
    GND
    DIOW ＃
    [2]
    DIOR ＃
    DMACK ＃
    V
    CC
    INTRQ
    DA0
    DA1
    DA2
    CS0#
    CS1#
    I / O
    GND
    PWR
    GND
    O / Z
    [1]
    驱动为高电平（ CMOS ）
    O / Z
    [1]
    驱动为高电平后， 2毫秒的延迟
    ATA地址。
    O / Z
    [1]
    驱动为高电平后， 2毫秒的延迟
    ATA地址。
    O / Z
    [1]
    驱动为高电平后， 2毫秒的延迟
    ATA地址。
    O / Z
    [1]
    驱动为高电平后， 2毫秒的延迟
    ATA芯片选择。
    O / Z
    [1]
    驱动为高电平后， 2毫秒的延迟
    ATA芯片选择。
    文件编号： 38-08031牧师* E
    第21 4

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