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CY7C68013A-128AXI 参数 Datasheet PDF下载

CY7C68013A-128AXI图片预览
型号: CY7C68013A-128AXI
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内容描述: EZ- USB FX2LP USB微控制器,高速USB外设控制器 [EZ-USB FX2LP USB Microcontroller High-Speed USB Peripheral Controller]
分类和应用: 微控制器
文件页数/大小: 66 页 / 909 K
品牌: CYPRESS [ CYPRESS SEMICONDUCTOR ]
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CY7C68013A , CY7C68014A
CY7C68015A , CY7C68016A
一个单和突发异步写入9.17.4序列图
图9-23 。 Slave FIFO异步写入序列和时序图
t
国家林业局
t
FAH
t
国家林业局
t
FAH
FIFOADR
t=0
t
WRpwl
t
WRpwh
T=0
t
WRpwl
t
WRpwh
t
WRpwl
t
WRpwh
t
WRpwl
t
WRpwh
SLWR
t =1
t=3
T=1
T=3
T=4
T=6
T=7
T=9
SLCS
t
XFLG
t
XFLG
FL AGS
t
SFD
t
FDH
t
SFD
t
FDH
N+1
T=2
T=5
t
SFD
t
FDH
N+2
t
SFD
t
FDH
N+3
T=8
数据
t=2
N
t
PEpwl
t
PEpwh
PKTEND
示出了从属FIFO的定时关系
写在异步模式。图中示出了单个
写后面的3个字节突发写入和提交的4
字节的短数据包使用PKTEND 。
相同的事件序列示于突发写入和是
通过5通过T的定时标记表示= 0 。
在突发写入模式下,解除SLWR后,数据
被写入到FIFO ,然后FIFO指针递增
到FIFO中的下一个字节。 FIFO指针是后
递增。
In
后的4个字节被写入到FIFO和
解除SLWR ,短期4个字节的数据包可以被提交
以使用PKTEND主机。外部设备应
目的是在不能断言SLWR和PKTEND信号
同一时间。它应该被设计后断言PKTEND
解除SLWR而且满足最小解除脉冲
宽度。 FIFOADDR行在不得不在保持不变
PKTEND断言。
在t = 0时,FIFO地址有效,并确保它满足
吨的建立时间
国家林业局
。如果使用SLCS ,还必须将其置
( SLCS可以绑定到低电平在某些应用中) 。
在t = 1 SLWR是断言。 SLWR必须满足最低
T的有效脉冲
WRpwl
和最小非活动脉冲宽度
t
WRpwh
。如果使用SLCS ,它必须被触发SLWR或
前SLWR是断言。
在t = 2时,数据必须存在于总线吨
SFD
拉高SLWR的边缘。
在t = 3时,解除SLWR使要被写入的数据
数据总线到FIFO中,然后递增FIFO指针。
FIFO标志吨后也更新
XFLG
来自的解除
SLWR的边缘。
文件编号: 38-08032牧师* V
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