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CY7C1360B-166AC 参数 Datasheet PDF下载

CY7C1360B-166AC图片预览
型号: CY7C1360B-166AC
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内容描述: 9兆位( 256K ×36 / 512K ×18 )流水线式SRAM [9-Mbit (256K x 36/512K x 18) Pipelined SRAM]
分类和应用: 静态存储器
文件页数/大小: 34 页 / 859 K
品牌: CYPRESS [ CYPRESS ]
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CY7C1360B  
CY7C1362B  
Switching Waveforms(continued)  
Read/Write Cycle Timing[22, 24, 25]  
t
CYC  
CLK  
t
t
CL  
CH  
t
t
ADH  
ADS  
ADSP  
ADSC  
t
t
AH  
AS  
A1  
A2  
A3  
A4  
A5  
A6  
ADDRESS  
BWE,  
t
t
WEH  
WES  
BW  
X
t
t
CEH  
CES  
CE  
ADV  
OE  
t
t
DH  
t
CO  
DS  
t
OELZ  
Data In (D)  
High-Z  
High-Z  
D(A3)  
D(A5)  
D(A6)  
t
t
OEHZ  
CLZ  
Data Out (Q)  
Q(A1)  
Q(A2)  
Q(A4)  
Q(A4+1)  
Q(A4+2)  
Q(A4+3)  
Back-to-Back READs  
Single WRITE  
BURST READ  
Back-to-Back  
WRITEs  
DON’T CARE  
UNDEFINED  
Notes:  
24.  
.
The data bus (Q) remains in high-Z following a Write cycle, unless a new Read access is initiated by  
ADSP or ADSC  
25. GW is HIGH.  
Document #: 38-05291 Rev. *C  
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