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951200301 参数 Datasheet PDF下载

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型号: 951200301
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内容描述: 抗辐射的32位SPARC嵌入式处理器 [Rad-Hard 32-bit SPARC Embedded Processor]
分类和应用: 微控制器和处理器外围集成电路微处理器异步传输模式ATM时钟
文件页数/大小: 42 页 / 2675 K
品牌: ATMEL [ ATMEL ]
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TSC695F  
Capacitance Ratings  
Parameter  
CIN  
Description  
Input Capacitance  
Max  
7 pF  
8 pF  
8 pF  
COUT  
Output Capacitance  
Input/Output Capacitance  
CIO  
AC Characteristics  
Table 7. AC Characteristics (SYSCLK Freq. = 25 MHz 5V ±10%) Cload = 50 pF, Vref = 2.5V  
Min  
(ns)  
Max  
(ns)  
Parameter  
Comment  
Reference Edge  
t1  
t2  
t3  
t4  
t5  
t6  
20  
40  
9.75  
CLK2 period  
SYSCLK period  
CLK2 high and low pulse width  
RA(31:0)RAPARRSIZERLDSTOoutputdelay  
6.5  
SYSCLK+  
SYSCLK+  
SYSCLK+  
12.5 MEMCS*(9:0) ROMCS* EXMCS* output delay  
15  
DDIR DDIR* output delay  
MEMWR* IOWR*output delay  
formula: 13.5 ns + 1/4 t2  
t7  
t8  
23.5  
SYSCLK- or SYSCLK+  
OE* HL output delay  
formula: 10.5 ns + 1/4 t2  
11.5  
9
20.5  
SYSCLK+  
SYSCLK+  
t9_1  
t9_2  
Data setup time during load  
t9  
Data setup time during load NOPAR = 0 rpa = rec  
= either 1 or 0  
SYSCLK+  
SYSCLK+  
SYSCLK-  
SYSCLK+  
SYSCLK+  
SYSCLK-  
t10  
t11  
t12  
t13  
t14  
5
8
Data hold time during load  
Data output delay  
28  
Data output valid to HZ – guaranteed by design  
CB output delay  
19  
13  
ALE* output delay  
BUFFEN* HL output delay  
formula: 11 ns + 1/4 t2  
t15  
21  
SYSCLK+  
SYSCLK+  
SYSCLK+  
SYSCLK-  
SYSCLK+  
SYSCLK+  
SYSCLK+  
t16  
t17  
t20  
t21  
t22  
t23  
15  
15  
15  
MHOLD* output delay – guaranteed by design  
MDS* DRDY* output delay  
MEXC* output delay  
10  
3
RASI(3:0) RSIZE(1:0) RASPAR setup time  
RASI(3:0) RSIZE(1:0) RASPAR hold time  
BOOT PROM address output delay  
13  
15  
4118J–AERO–08/04  
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