的XPressArray -II
0.15
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米结构化ASIC
4.0的XPressArray -II架构
图3示出用的XPressArray -II器件架构
嵌入式块RAM ， DCI ， DDR的支持文件，DLL ， PLL和
对于I / O标准的完整的恭维支持。
数据表
DCI
DLL
BRAM
I / O的
I / O的
DDR
DLL
DCI
BRAM
DDR
CORE
CORE
PLL
DDR
PLL
BRAM
I / O的
BRAM
BRAM
DLL
DDR
DLL
DCI
DCI
I / O的
图3 ：的XPressArray - II架构
5.0 I / O说明
在的XPressArray - II I / O环是由统一的I / O单元网站
并且每个站点可进行定制以支持任何I / O标准。
在I / O电源环被分成八个段，使得它
内置的FPGA产品和电源环兼容
进入的包。
如在列I / O单元可用于各种各样的标准
表3. I / O单元，在1.5V ， 1.8V ，2.5V和3.3V操作。 3.3V
宽容的I / O也可提供。差分信号标准
通常需要两个垫的网站。需要信令标准
参考电压通常共享一个共同的参考电压
一个I / O电源环段，用参考电压范围内
通过从一个片源的I / O现场供电。
图4示出了在I / O单元的体系结构。包括有
可编程的上拉，下拉电阻以及一个总线保持
锁存器来限制对三态总线信号的噪声。专用双
数据速率（ DDR ）触发器有利于高速通信
与I / O速度高达采用LVDS收发器工作在1Gbps
与DLL / PLL时钟管理电路结合。
数字控制阻抗是许多I / O标准
消除片外端接电阻。图5示出了
终端方案适用于所有的XPressArray - II的I / O单元。
设计人员可以使用的的DDR和DCI功能
对于DDR SDRAM内存和并行的XPressArray - II I / O单元
高速点对点接口。
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