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    EP1S20F672C7N 参数 Datasheet PDF下载

    EP1S20F672C7N图片预览
    型号： EP1S20F672C7N
    PDF下载： 下载PDF文件 查看货源
    内容描述： [Field Programmable Gate Array, 2132 CLBs, 18460-Cell, CMOS, PBGA672, 35 X 35 MM, 1.27 MM PITCH, LEAD FREE, BGA-672]
    分类和应用： 栅
    文件页数/大小： 292 页 / 1528 K
    品牌： ALTERA [ ALTERA CORPORATION ]
     浏览型号EP1S20F672C7N的Datasheet PDF文件第79页浏览型号EP1S20F672C7N的Datasheet PDF文件第80页浏览型号EP1S20F672C7N的Datasheet PDF文件第81页浏览型号EP1S20F672C7N的Datasheet PDF文件第82页浏览型号EP1S20F672C7N的Datasheet PDF文件第84页浏览型号EP1S20F672C7N的Datasheet PDF文件第85页浏览型号EP1S20F672C7N的Datasheet PDF文件第86页浏览型号EP1S20F672C7N的Datasheet PDF文件第87页  
    Stratix Architecture  
    Figure 2–33. Multiplier Sub-Blocks Using Input Shift Register Connections  
    Note (1)  
    Data A  
    D
    Q
    ENA  
    A[n] × B[n]  
    D
    Q
    CLRN  
    ENA  
    Data B  
    D
    Q
    CLRN  
    ENA  
    CLRN  
    Data B  
    Data A  
    D
    Q
    Q
    ENA  
    A[n Ð 1] × B[n Ð 1]  
    D
    Q
    CLRN  
    ENA  
    D
    CLRN  
    ENA  
    CLRN  
    Data A  
    Data B  
    D
    Q
    Q
    ENA  
    A[n Ð 2] × B[n Ð 2]  
    D
    Q
    CLRN  
    ENA  
    D
    CLRN  
    ENA  
    CLRN  
    Note to Figure 2–33:  
    (1) Either Data A or Data B input can be set to a parallel input for constant coefficient  
    multiplication.  
    Altera Corporation  
    July 2005  
    2–59  
    Stratix Device Handbook, Volume 1  
     
     
     

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