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5ASXMB3E4F31I3N 参数 Datasheet PDF下载

5ASXMB3E4F31I3N图片预览

型号：	5ASXMB3E4F31I3N
PDF下载：	下载PDF文件查看货源
内容描述：	[Field Programmable Gate Array, 670MHz, PBGA896, ROHS COMPLIANT, FBGA-896]
分类和应用：	时钟LTE栅可编程逻辑
文件页数/大小：	184 页 / 1809 K
品牌：	ALTERA [ ALTERA CORPORATION ]

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AV-51002

2017.02.10

1-55

LVDS Soft-CDR/DPA Sinusoidal Jitter Tolerance Speciﬁcations

LVDS Soft-CDR/DPA Sinusoidal Jitter Tolerance Speciﬁcations

Figure 1-5: LVDS Soft-Clock Data Recovery (CDR)/DPA Sinusoidal Jitter Tolerance Speciﬁcation for a Data Rate Equal to 1.25 Gbps

25

8.5

0.35

0.1

F1 F2

F3

F4

Jitter Frequency (Hz)

Table 1-42: LVDS Soft-CDR/DPA Sinusoidal Jitter Mask Values for a Data Rate Equal to 1.25 Gbps

Jitter Frequency (Hz)

Sinusoidal Jitter (UI)

25.000

F1

F2

F3

F4

10,000

17,565

25.000

1,493,000

50,000,000

0.350

0.350

Arria V GX, GT, SX, and ST Device Datasheet

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