ADSP-BF532SBB400 参数 Datasheet PDF下载

型号：	ADSP-BF532SBB400
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内容描述：	Blackfin㈢嵌入式处理器 [Blackfin㈢ Embedded Processor]
分类和应用：
文件页数/大小：	60 页 / 3447 K
品牌：	AD [ ANALOG DEVICES ]

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ADSP-BF531/ADSP-BF532/ADSP-BF533

并行外设接口时序

表21

和

图16

通过

图21第33页

描述

并行外设接口操作。

表21.并行外设接口时序

DDEXT

= 1.8 V

LQFP / PBGA封装

民

最大

8.0

20.0

6.0

1.0

2.0

3.5

1.5

11.0

1.7

11.0

1.8

9.0

1.8

DDEXT

= 1.8 V

MBGA封装

民

最大

8.0

20.0

6.0

1.0

2.0

3.5

1.5

8.0

1.7

9.0

DDEXT

= 2.5 V/3.3 V

所有的包

民

最大

单位

6.0

15.0

4.0

6.0

1.0

2.0

3.5

1.5

8.0

参数

时序要求

PCLKW

PPI_CLK宽度

PCLK

PPI_CLK期

SFSPE

外部帧同步设置PPI_CLK边缘前

（非采样边沿进行接收，采样边沿用于Tx ）

HFSPE

外部帧同步保持PPI_CLK后

SDRPE

接收数据设置PPI_CLK前

HDRPE

接收数据保持PPI_CLK后

开关特性-GP输出和帧捕获模式

DFSPE

内部帧同步延迟PPI_CLK后

HOFSPE

内部帧同步保持PPI_CLK后

1.7

DDTPE

数据传输延迟PPI_CLK后

HDTPE

传输数据保持PPI_CLK后

1.8

PPI_CLK频率不能超过˚F

SCLK

适用于当PPI_CONTROL第8位被清除。看

图17第31页

和

图20在第32页。

适用于当PPI_CONTROL第8位被置位。看

图18第31页

和

图21第33页。

FRAME

SYNC

驱动的

OUT

POLC = 0

PPI_CLK

DATA0

采样

PPI_CLK

POLC = 1

DFSPE

POLS = 1

PPI_FS1

POLS = 0

HOFSPE

POLS = 1

PPI_FS2

POLS = 0

SDRPE

HDRPE

PPI_DATA

图16. PPI GP RX模式与内部帧同步定时

修订版E |

第60页30 |

2007年7月

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