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    AD73311LARS 参数 Datasheet PDF下载

    AD73311LARS图片预览
    型号： AD73311LARS
    PDF下载： 下载PDF文件 查看货源
    内容描述： 低成本，低功耗CMOS通用模拟前端 [Low Cost, Low Power CMOS General Purpose Analog Front End]
    分类和应用： 电信集成电路电信电路光电二极管
    文件页数/大小： 36 页 / 380 K
    品牌： AD [ ANALOG DEVICES ]
     浏览型号AD73311LARS的Datasheet PDF文件第1页浏览型号AD73311LARS的Datasheet PDF文件第2页浏览型号AD73311LARS的Datasheet PDF文件第3页浏览型号AD73311LARS的Datasheet PDF文件第5页浏览型号AD73311LARS的Datasheet PDF文件第6页浏览型号AD73311LARS的Datasheet PDF文件第7页浏览型号AD73311LARS的Datasheet PDF文件第8页浏览型号AD73311LARS的Datasheet PDF文件第9页  
    AD73311L
    表II中。信号范围
    参数
    V
    REFCAP
    V
    REFOUT
    ADC
    DAC
    条件
    信号范围
    1.2 V
    ±
    10%
    1.2 V
    ±
    10%
    1.578 V P-P
    1.0954 V P-P
    最大输入范围在V
    IN
    标称参考电平
    最大电压
    输出摆幅
    单端
    迪FF erential
    额定电压
    输出摆幅
    单端
    迪FF erential
    输出偏置电压
    1.578 V P-P
    3.156 V P-P
    1.0954 V P-P
    2.1909 V P-P
    V
    REFOUT
    时序特性
    参数
    时钟信号
    t
    1
    t
    2
    t
    3
    串行端口
    t
    4
    t
    5
    t
    6
    t
    7
    t
    8
    t
    9
    t
    10
    t
    11
    t
    12
    t
    13
    （ AVDD = DVDD = 2.7 V至3.6 V ; AGND = DGND = 0 V ;吨
    A
    = T
    MLN
    给T
    最大
    中，除非另有说明）
    单位
    ns（最小值）
    ns（最小值）
    ns（最小值）
    ns（最小值）
    ns（最小值）
    ns（最小值）
    ns（最小值）
    ns（最小值）
    ns（最大值）
    ns（最小值）
    ns（最小值）
    ns（最大值）
    ns（最大值）
    描述
    见图1
    MCLK周期
    MCLK宽高
    MCLK宽度低
    参见图3和4
    SCLK周期
    SCLK宽高
    SCLK宽度低
    SDI / SDIFS设置SCLK前低
    SDI / SDIFS保持SCLK后低
    SDOFS延迟从SCLK高
    SDOFS保持SCLK高后
    SDO保持SCLK高后
    SDO延迟从SCLK高
    SCLK延迟从MCLK
    100 A
    I
    OL
    在极限
    T
    A
    = -40°C至+ 105 ç
    61
    24.4
    24.4
    t
    1
    0.4
    ×
    t
    1
    0.4
    ×
    t
    1
    20
    0
    10
    10
    10
    10
    30
    t
    1
    t
    2
    输出
    针
    2.1V
    C
    L
    15pF
    100 A
    I
    OH
    t
    3
    图1. MCLK时序
    t
    1
    图2.负载电路的时序特定网络阳离子
    t
    2
    t
    3
    MCLK
    t
    13
    SCLK
    *
    t
    5
    t
    4
    t
    6
    *
    SCLK单独编程
    在频率（ MCLK / 4此处所示） 。
    图3. SCLK时序
    –4–
    REV 。一

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