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    HT46R47(18SOP-A) 参数 Datasheet PDF下载

    HT46R47(18SOP-A)图片预览
    型号： HT46R47(18SOP-A)
    PDF下载： 下载PDF文件 查看货源
    内容描述： 模拟IC\n [Analog IC ]
    分类和应用： 模拟IC
    文件页数/大小： 45 页 / 293 K
    品牌： ETC [ ETC ]
     浏览型号HT46R47(18SOP-A)的Datasheet PDF文件第1页浏览型号HT46R47(18SOP-A)的Datasheet PDF文件第2页浏览型号HT46R47(18SOP-A)的Datasheet PDF文件第3页浏览型号HT46R47(18SOP-A)的Datasheet PDF文件第4页浏览型号HT46R47(18SOP-A)的Datasheet PDF文件第6页浏览型号HT46R47(18SOP-A)的Datasheet PDF文件第7页浏览型号HT46R47(18SOP-A)的Datasheet PDF文件第8页浏览型号HT46R47(18SOP-A)的Datasheet PDF文件第9页  
    HT46R47  
    Test Conditions  
    Symbol  
    Parameter  
    Min. Typ. Max. Unit  
    VDD  
    3.3V  
    5V  
    Conditions  
    ¾
    ¾
    ¾
    40  
    10  
    ¾
    60  
    30  
    80  
    50  
    ±1  
    kW  
    kW  
    RPH  
    EAD  
    Pull-high Resistance  
    A/D Conversion Error  
    5V  
    ±0.5  
    LSB  
    A.C. Characteristics  
    Ta=25°C  
    Test Conditions  
    Symbol  
    fSYS1  
    Parameter  
    Min. Typ. Max. Unit  
    VDD  
    3.3V  
    5V  
    Conditions  
    ¾
    ¾
    ¾
    ¾
    ¾
    ¾
    ¾
    ¾
    ¾
    ¾
    400  
    400  
    400  
    400  
    0
    ¾
    ¾
    4000 kHz  
    8000 kHz  
    4000 kHz  
    8000 kHz  
    4000 kHz  
    8000 kHz  
    System Clock  
    (Crystal OSC)  
    3.3V  
    5V  
    ¾
    fSYS2  
    System Clock (RC OSC)  
    ¾
    3.3V  
    5V  
    ¾
    fTIMER  
    Timer I/P Frequency (TMR)  
    0
    ¾
    tAD  
    A/D Clock Period  
    5V  
    1
    ¾
    ¾
    ¾
    ms  
    tAD  
    ms  
    ms  
    s
    tADC  
    A/D Conversion Time  
    76  
    86  
    72  
    5.6  
    4.7  
    ¾
    ¾
    3.3V  
    5V  
    43  
    36  
    2.8  
    2.3  
    168  
    144  
    11  
    tWDTOSC  
    Watchdog Oscillator  
    3.3V  
    5V  
    Watchdog Time-out Period  
    (RC)  
    tWDT1  
    ¾
    9.4  
    s
    Watchdog Time-out Period  
    (System Clock)  
    tWDT2  
    tSYS  
    ¾
    ¾
    ¾
    ¾
    217  
    ¾
    ¾
    218  
    External Reset Low Pulse  
    Width  
    tRES  
    1
    ¾
    ms  
    System Start-up Timer  
    Period  
    tSST  
    tINT  
    *tSYS  
    ¾
    ¾
    Wake-up from HALT  
    ¾
    1024  
    ¾
    ¾
    Interrupt Pulse Width  
    ¾
    1
    ¾
    ms  
    Note: *tSYS=1/fSYS  
    Rev. 1.40  
    5
    July 18, 2001  

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