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VSC870TX图片预览
型号: VSC870TX
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内容描述: 高性能串行背板收发器 [High Performance Serial Backplane Transceiver]
分类和应用: 线路驱动器或接收器驱动程序和接口接口集成电路
文件页数/大小: 40 页 / 512 K
品牌: VITESSE [ VITESSE SEMICONDUCTOR CORPORATION ]
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Vitesse公司
半导体公司
数据表
VSC870
高性能串行
背板收发器
收发信机接收并馈送该串行数据流以一个数字的CRU来恢复比特时钟和反序列化
数据流,以32位字加2开销位在的62.5MHz 。该收发器还使用此恢复时钟
序列被发送到交换机其发射数据的话。在这种方式中,开关和所有的收发信机是
频率锁定到由交换机卡上的字时钟提供一个时钟源。该收发器
提供了自己的CMU它由34乘以当地REFCLK中央结算系统的输出可以帮助CRU获得锁
并提供时钟源,在环回模式收发器。这个本地的REFCLK必须在100ppm的
交换芯片的参考时钟频率。在直接模式下,主收发器使用CMU提供时钟
为发送数据。从机接收器恢复从串行位流的时钟。
1.1.4字同步
在上电或复位时,该收发器可以启动这个词同步过程。首先,收发器
发送复位模式的开关(或在直接模式下的主收发器)来请求所述开关​​启动
初始化过程。交换机在接收到这个请求,就会发出特殊的ALIGN话。该收发器
接收从开关这个串行数据流,并使用RXCLK发生器来调节接收字时钟
在同一时间,直到字/细胞定位仪边界一位检测正确对齐。一旦检测到正确的单词
对准,则RXOK信号置为低电平和字对齐处理开始在发送侧。在这
过程中,收发器不断发送ALIGN字使用对齐字发生器的开关。该
交换机使用自己的字时钟来检测这个ALIGN字。如果发射机字没有对齐到开关芯片
字时钟,当它到达交换机时,交换机芯片继续发出ALIGN话。每接收后
来自开关芯片32 ALIGN即,收发信机通过一个比特位置使用改变它的发送字边界
在TXCLK发生器,然后重复该过程(这限制了从所述收发器的距离,切换到少
然后180nS单程) 。如果开关正确地检测到这个ALIGN字,它发送空闲字到收发信机来
信号发射机现在有字与交换机同步。当收发信机中检测到这些空闲
即,信号TXOK变为低并且该并行数据信号TXIN [31: 0], TXTYP [1: 0], RXOUT [31:0 ]和
RXTYP [1:0 ]然后被相位对齐的字时钟( WSOUT ) 。
发送字时钟是在销WSOUT输出。如果一个单一的收发器被用于对一个端口卡, WSOUT
必须直接连接到WSIN 。信号WSIN作为时钟输入的所有收发器的并行逻辑和
提供字时钟输出( WCLK ) 。重定时模块用于在所述收发器以跨越相界
之间WSIN和发射字时钟和接收字时钟。如果两个或多个收发信机中使用的
为了增加带宽,并行的端口卡,每个都有其自己的传送字时钟。由于这些字
时钟被从开关卡上的同一来源,它们将具有相同的频率,但相位相差
达为8ns 。该相位差(偏移)取决于开关和收发信机和所述串行数据的I / O延迟
这些芯片之间的线路延迟。要正确相位对齐所有收发器的并行接口,一个收发器充当
主,在该端口上的所有其他收发器提供了WSOUT信号,不仅自身WSIN ,但WSIN
卡(请参阅应用笔记32 :设计指南基于信元的交换与中央控制) 。这意味着该
在所有收发器的并行逻辑块的时钟由的发送字时钟信号将通过相同的源
主收发器。以这种方式,倾斜之间的所有收发器的并行接口最小化。在其他逻辑
端口卡可以使用WSOUT主收发器,或任何收发器的WCLK输出时钟源而
是WSOUT的延迟版本。 A相偏移字时钟也可以用来驱动WSIN ,只要它是
频率锁定到WSOUT信号。以这种方式,在接收和发送的并行接口可以是相
对准这个字时钟。
G52190-0 ,版本4.1
01/05/01
©
Vitesse公司
半导体公司
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