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型号: VSC8114QB1
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内容描述: ATM / SONET / SDH 622 Mb / s的收发器复用/解复用,集成时钟发生器和时钟恢复 [ATM/SONET/SDH 622 Mb/s Transceiver Mux/Demux with Integrated Clock Generation and Clock Recovery]
分类和应用: 时钟发生器ATM集成电路SONET集成电路SDH集成电路电信集成电路电信电路异步传输模式
文件页数/大小: 24 页 / 437 K
品牌: VITESSE [ VITESSE SEMICONDUCTOR CORPORATION ]
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Vitesse公司
半导体公司
ATM / SONET / SDH 622 Mb / s的收发器,复用器/解复用器
集成时钟发生器和时钟恢复
数据表
VSC8114
PECL输入LOSPECL迫使部分进入的信号状态的丢失。大多数光学元件有一个PECL输出通常
所谓的“SD ”或“标志”表示光功率的存在或缺乏。根据不同的光学器件制造商
这个信号是高电平还是低电平有效。该LOSTTL和LOSPECL输入XNOR'd生成
新浪内部控制信号。参见图2光学“ SD”输出应连接到LOSPECL 。该
LOSTTL输入应连接到低,如果光学“ SD”为高电平有效。如果是低电平有效领带LOSTTL到高。
相反的是真实的,如果使用光学“旗帜”的信号丢失
图2 :数据和时钟接收框图
VSC8114
LOSPECL
LOSTTL
LOSDETEN_
DSBLCRU
RXDATAIN +/-
LOSDET
PM5355
ð Q
ð Q
RXOUT [7 :0]的
ð Q
1
0
CRU
0
Divide-by-8
0
1
CMU
ð Q
FP
ð Q
RXLSCKOUT
RxCLKIN +/-
1
基金回环
该基金回环功能由FACLOOP信号控制。当FACLOOP信号设置
高,该基金回模式被激活和高速串行接收数据( RXDATAIN )提出
到高速发送输出( TXDATAOUT ) 。参见图3。在设备环回模式下高速
接收数据( RXDATAIN )也被转换成并行数据并提供给低速率接收数据输出
销( RXOUT [7: 0])。接收时钟( RXCLKIN )也被分割下来并呈现给低速时钟
输出( RXLSCKOUT ) 。
图3 :设备回送数据路径
rxdatain
CRU
回收
时钟
D
Q
1:8
串行
并行
D
Q
RXOUT [7 :0]的
0
1
Q
D
RxCLKIN
txdataout
1
0
8:1
平行
串行
Q
D
TXIN [7 :0]的
1
0
PLL
FACLOOP
第4页
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Vitesse公司
半导体公司
741卡莱普莱诺,卡马里奥,CA 93012 • 805 / 388-3700 •传真: 805 / 987-5896
G52185-0 ,版本4.0
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