SLLSEB6A - 2012年7月 - 修订2012年10月
证明了我的切换行为
2
Ç隔离， ISO1540 ，在SDA1主节点之间
在SDA2沉重的负载总线
VCC2
VCC2
50%
30%
VCC1
VCC1
SDA2
SDA1
V
IHT1
发送
延迟
V
OL1
接受
延迟
接受
延迟
VCC1
接受
延迟
VCC1
VCC2
发送
延迟
VCC2
V
IHT2
SDA1
50%
30%
SDA2
图10. SDA通道时序接收和发送方向
接收方向（左图）
当我
2
C总线驱动器SDA2低， SDA1一定的延迟，在接收路径后如下。其输出低电平会
V的缓冲输出
OL1
= 0.75V，这是足够低，以通过施密特触发器输入与被检测
V最小输入电压低
IL
= 0.9 V ，3 V电源的水平。
一旦SDA2被释放出来，向VCC2以下的电压电势的增加时间常数由R形成
PU2
和C
公共汽车
。接收延迟后， SDA1被释放，并且还升向VCC1 ，以下的时间常数
R
PU1
乘C
节点
。由于显著较低的时间常数， SDA1可能达到SDA2到达之前VCC1
VCC2潜力。
发送方向（右图）
当一个主驱动器SDA1低， SDA2一定的延迟在发送方向后如下。当SDA2打开
低也导致缓冲器B的输出转低，但在更高的0.75 V电平。这个电平不能被观察
立即因为它是由主站的低级低级别覆盖。
然而，当主器件释放SDA1 ，其电压电势增加，并且首先必须通过上侧的输入
比较器，V的阈值
IHT1
以释放SDA2 。 SDA1然后进一步增加，直至达到所缓冲
V的输出电平
OL1
= 0.75V，由接收路径保持。一旦比较C变为高电平， SDA2发布
后在发送方向上的延迟。另需到B的输出变为高，充分释放延迟领取
SDA1走向VCC1潜力。
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