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ADC101S051CISDX 参数 Datasheet PDF下载

ADC101S051CISDX图片预览
型号: ADC101S051CISDX
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内容描述: 单通道, 200 〜500 ksps的10位A / D转换器 [Single Channel, 200 to 500 ksps, 10-Bit A/D Converter]
分类和应用: 转换器
文件页数/大小: 16 页 / 724 K
品牌: TAOS [ TEXAS ADVANCED OPTOELECTRONIC SOLUTIONS ]
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ADC101S051
ADC101S051转换器电气特性
(注7,9)
(续)
以下规格适用于V
A
= + 2.7V至5.25V ,女
SCLK
= 4 MHz至10 MHz的,女
样品
= 200 kSPS时为500 kSPS时,
C
L
= 15 pF的,除非另有说明。
黑体字限额适用于对于T
A
= T
给T
最大
:所有其他限制牛逼
A
= 25˚C.
参数
条件
典型
范围
40
60
400
采集时间+转换时间
3
30
20
50
单位
符号
AC电气特性
DC
t
ACQ
t
安静
t
AD
t
AJ
SCLK占空比
采样/保持捕获时间
生产时间
孔径延迟
孔径抖动
f
SCLK
= 10 MHz的
50
% (分钟)
%(最大值)
NS (最大值)
SCLK周期
NS (分钟)
ns
ps
ADC101S051时序规范
以下规格适用于V
A
= + 2.7V至5.25V , GND = 0V ,女
SCLK
= 4 MHz至10 MHz的,C
L
= 25 pF的,
f
样品
= 200 kSPS时为500 kSPS时,
黑体字限额适用于对于T
A
= T
给T
最大
:所有其他限制牛逼
A
= 25˚C.
符号
t
CS
t
SU
t
EN
t
t
CL
t
CH
t
H
参数
CS最小脉冲宽度
CS到SCLK建立时间
延迟从CS直到SDATA TRI- STATE
®
残疾人(注11 )
数据访问时间SCLK下降沿后
SCLK低电平脉冲宽度
SCLK高脉冲宽度
SCLK到数据有效保持时间
V
A
= + 2.7V至+ 3.6V
V
A
= + 4.75V至+ 5.25V
V
A
= + 2.7V至+ 3.6V
V
A
= + 4.75V至+ 5.25V
1
V
A
= + 2.7V至+ 3.6V
V
A
= + 4.75V至+ 5.25V
条件
典型
范围
10
10
20
40
20
0.4 x深
SCLK
0.4 x深
SCLK
7
5
25
5
25
5
单位
NS (分钟)
NS (分钟)
NS (最大值)
NS (最大值)
NS (最大值)
NS (分钟)
NS (分钟)
NS (分钟)
NS (分钟)
NS (最大值)
NS (分钟)
NS (最大值)
NS (分钟)
µs
t
DIS
SCLK下降沿到SDATA高
阻抗(注13 )
电源从完全关断时间
t
上电
注1 :
最大极限值是指超出这可能会损坏设备的限制。工作额定值表明条件,该设备是
功能,但不保证特定的性能极限。关于规范保证和测试环境,请参阅电气特性。保证
规格仅适用于列出的测试条件。一些性能特性可能会降低,当设备没有下所列出的测试操作
条件。
注2 :
所有电压都相对于GND = 0V测定,除非另有规定。
注3 :
当在任何引脚上的输入电压超过电源(即,V
IN
& LT ;
GND或V
IN
& GT ;
V
A
),电流在该引脚应限制在10毫安。 20
毫安最大包输入电流限制引脚,可以安全地超过电源电压为10毫安输入电流至2的数。绝对
最大额定值规范并不适用于V
A
引脚。目前进入V
A
引脚由模拟电源电压规格的限制。
注4 :
绝对最高结温(T
J
最大值)为这个设备是150°C 。最大允许功耗为T决定
J
最大值,则
结点至环境热阻( θ
JA
) ,并在环境温度(T
A
) ,并且可以使用公式P计算
D
MAX = (T
J
马克斯 - T的
A
) /
θ
JA
。值
对于上面列出的最大功率耗散会达到仅当该装置在一个严重故障条件下操作(例如,当输入或输出引脚被驱动
超出电源电压,或者将电源极性是相反的) 。很明显,任何时候都要避免这样的条件。
注5 :
人体模型是100pF的电容通过一个1.5 kΩ的电阻放电。机器型号为220 pF的通过零欧姆放电。
注6 :
回流焊温度曲线是无铅和无无铅封装不同。
注7 :
测试的范围,保证国家的AOQL (平均出厂质量水平) 。
注8 :
这是在频率范围在其上的电性能有保证。该装置是功能性在其上在特定的范围更广
工作额定值。
注9 :
数据表的最小/最大规格限制由设计,测试或统计分析保证。
注10 :
所需的总线释放,下一个转换的开始最低安静时间。
注11 :
测得的与图1中示出并定义为采取的输出信号进行交叉1.0V时的时序测试电路。
注12 :
测得的与图1中示出并定义为采取的输出信号越过1.0V或2.0V时的时序测试电路。
注13 :
t
DIS
从采取的输出时间导出了0.5V ,在图1中所示的时序测试电路来改变测量的数目,然后被调节
以除去的充电或放电的输出电容的影响。这意味着吨
DIS
是真正的总线释放时间,独立的总线负载。
5
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