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    HV57009_07 参数 Datasheet PDF下载

    HV57009_07图片预览
    型号： HV57009_07
    PDF下载： 下载PDF文件 查看货源
    内容描述： 64通道串行到并行转换器采用P沟道开漏输出可控制输出电流 [64-Channel Serial to Parallel Converter with P-Channel Open Drain Controllable Output Current]
    分类和应用： 转换器
    文件页数/大小： 8 页 / 802 K
    品牌： SUPERTEX [ Supertex, Inc ]
     浏览型号HV57009_07的Datasheet PDF文件第1页浏览型号HV57009_07的Datasheet PDF文件第2页浏览型号HV57009_07的Datasheet PDF文件第4页浏览型号HV57009_07的Datasheet PDF文件第5页浏览型号HV57009_07的Datasheet PDF文件第6页浏览型号HV57009_07的Datasheet PDF文件第7页浏览型号HV57009_07的Datasheet PDF文件第8页  
    HV57009
    DC电气特性
    （所有电压参考V
    符号
    I
    DD
    I
    NN
    I
    DDQ
    V
    OH
    V
    OL
    I
    IH
    I
    IL
    I
    CS
    ΔI
    CS
    参数
    V
    DD
    电源电流
    高电压电源电流
    静态V
    DD
    电源电流
    高电平输出
    低电平输出
    数据输出
    HV
    OUT
    数据输出
    民
    -
    -
    -
    V
    DD
    - 0.5V
    +1.0
    -
    -
    -
    -
    高输出源电流
    -0.1
    高压输出的电流源我
    REF
    = 2.0毫安
    -
    -
    10
    mA
    %
    SS
    , V
    SS
    = 0, T
    A
    = 25
    O
    C)
    最大
    15
    -10
    100
    -
    V
    DD
    +0.5
    1.0
    -1.0
    -2.0
    单位
    mA
    µA
    µA
    V
    V
    V
    µA
    µA
    mA
    条件
    V
    DD
    = V
    DD
    最大，女
    CLK
    = 8.0MHz
    输出关闭， HV
    OUT
    = -85V
    （所有输出）
    所有输入= V
    DD
    ,
    除+ IN = V
    SS
    = GND
    I
    O
    = -100µA
    I
    O
    = -2.0mA
    I
    O
    = 100µA
    V
    IH
    = V
    DD
    V
    IL
    = 0V
    V
    REF
    = 2.0V ，R
    EXT
    = 1K,
    请参阅图1a和1b
    V
    REF
    = 0.1V ，R
    EXT
    = 1K,
    请参阅图1a和1b
    V
    REF
    = 2.0V ，R
    EXT
    = 1K
    高层次的逻辑输入电流
    低逻辑电平输入电流
    注意：
    当前外出的芯片被认为是负
    .
    AC电气特性
    （逻辑信号输入和数据输入有吨，吨≤为5ns [10 ％和90％分]进行测量）
    r
    f
    符号
    f
    CLK
    t
    WL
    , t
    WH
    t
    SU
    t
    H
    t
    ON
    , t
    关闭
    t
    DHL
    t
    DLH
    t
    DLE
    t
    WLE
    t
    SLE
    t
    r
    , t
    f
    参数
    时钟频率
    时钟宽高还是低
    数据建立时间时钟上升之前
    数据保持时间时钟上升后
    从锁定时间能到HV
    OUT
    延迟时间时钟数据前高后低
    延迟时间的时钟将数据从低到高
    延时时钟LE低到高
    LE脉冲宽度
    LE建立时间时钟上升之前
    马克斯。允许时钟的上升和下降时间
    （10 ％和90％点）
    民
    DC
    62
    20
    15
    -
    -
    -
    45
    25
    0
    -
    最大
    8.0
    4.5
    -
    -
    -
    500
    150
    150
    -
    -
    -
    100
    单位
    兆赫
    ns
    ns
    ns
    ns
    ns
    ns
    ns
    ns
    ns
    ns
    条件
    每个寄存器
    当级联设备
    ---
    ---
    ---
    C
    L
    = 15pF的
    C
    L
    = 15pF的
    C
    L
    = 15pF的
    ---
    ---
    ---
    ---
    3

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