BM28723AMUV 参数 Datasheet PDF下载

型号：	BM28723AMUV
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内容描述：	[BM1050AF是组合了应对高次谐波的功率因数校正（Power Factor Correction）转换器（以下简称PFC部）与DC/DC转换器（以下简称DC/DC部）的复合LSI。DC/DC部采用准谐振方式动作，有助于实现低EMI。BM1050AF内置650V耐压启动电路。PFC部、DC/DC部均外接开关MOSFET及电流检测电阻，可实现自由度高的电源设计。PFC部采用峰值电流控制。利用带AC电压过低补偿电路的乘法器、应对负载变动的电路、最大功率补偿电路等各种保护电路，提供合适的应用方案。此外，内置跳频功能，有助于实现低EMI。DC/DC部的准谐振方式为软开关动作，有助于实现低EMI。内置脉冲串模式，可降低轻负载时的功耗。内置了软启动功能、脉冲串功能、逐周期过电流限制、过电压保护、过负荷保护等各种保护功能。与微控制器间设有通信控制用端子、外部停止端子，可提供适用于各种应用的系统方案。]
分类和应用：	通信开关控制器微控制器软启动脉冲功率因数校正转换器
文件页数/大小：	82 页 / 5460 K
品牌：	ROHM [ ROHM ]

BM28723AMUV

Description of Function - continued

10 Audio Interface Format and Timing

Electrical characteristics and timing of BCLK, LRCLK and SDATA

1/f_LRCLK

V_IH

LRCLK

V_IL

T_r

T_f

1/f_BCLK

V_IH

V_IL

BCLK

T_r

T_f

Figure 41. Clock Timing

T_HLRCLK

V_IH

V_IL

LRCLK

T_LLRCLK

t_HD;LR

t_SU;LR

T_HBCLK

V_IH

V_IL

BCLK

T_LBCLK

t_SU:SD

t_HD:SD

V_IH

V_IL

SDATA

LRCLK DUTY=f_LRCLKx (T_HLRCLKor T_LLRCLK

)

BCLK DUTY =f_BCLKx (T_HBCLKor T_LBCLK

)

Figure 42. Audio Interface Timing

Limit

No.

Parameter

LRCLK Frequency

BCLK Frequency

Symbol

f_LRCLK

f_BCLK

Unit

kHz

Min

-10%

2.048

-10%

Max

+10%

3.072

MHz

+10%

Setup Time, LRCLK^{(Note 19)}

Hold Time, LRCLK^{(Note 19)}

Setup Time, SDATA

Hold Time, SDATA

LRCLK, DUTY Ratio

BCLK, DUTY Ratio

LRCLK, BCLK,

t_SU;LR

t_HD;LR

t_SU;SD

t_HD;SD

d_LRCLK

d_BCLK

T_r,T_f

Rise Time, Fall Time

(Note 19) This regulation is to keep rising edge of LRCLK and rising edge of BCLK from overlapping.

www.rohm.com

TSZ02201-0C1C0E900720-1-2

31.Aug.2018 Rev.001

26/79

TSZ22111 • 15 • 001

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