PE9704
超前信息
表6. AC特性
V
DD
= 3.0 V， -40°C <牛逼
A
< 85 ℃，除非另有说明
符号
f
CLK
t
CLKH
t
CLKL
t
DSU
t
DHLD
t
PW
t
无缝线路
t
CE
t
WRC
t
EC
t
MDO
F
IN
P
鳍
F
IN
P
鳍
参考分频器
F
R
P
Fr
相位检测器
f
c
注1 ：
比较频率
（注3）
20
兆赫
工作频率
参考输入功率（注2 ）
（注3）
单端输入
-2
100
兆赫
DBM
参数
时钟串行数据时钟频率
时钟串行时钟高电平时间
时钟串行时钟低电平时间
之后，时钟上升沿数据建立时间
时钟上升沿后数据保持时间
S_WR脉冲宽度
时钟上升沿到S_WR上升沿。
时钟下降沿到E_WR过渡
S_WR下降沿到时钟上升沿。
E_WR过渡到时钟上升沿
MSEL数据输出延时F以后，
IN
上升沿
工作频率
输入电平范围
工作频率
输入电平范围
条件
（注1 ）
民
最大
10
单位
兆赫
ns
ns
ns
ns
ns
ns
ns
ns
ns
控制接口和锁存器（见图1和3 ）
30
30
10
10
30
30
30
30
30
C
L
= 12 pF的
500
外部交流耦合
-5
50
外部交流耦合
-5
8
3000
5
300
5
ns
兆赫
DBM
兆赫
DBM
主分频器（包括预分频器）
主分频器（预分频器绕过）
功能模式测试期间FCLK验证。的功能模式串行编程部分的时钟频率为10 MHz ，以验证FCLK
特定连接的阳离子。
注2 ：
注3 ：
CMOS逻辑电平可以被用来驱动参考输入，如果直流耦合。电压输入需要的最小0.5V的
p-p
.
参数只能通过特性保证，未经测试。
版权
Peregrine半导体公司2003
文件编号70 / 0083〜 00B
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UTSI
CMOS RFIC解决方案
第12页6
PEREGRINE [ PEREGRINE SEMICONDUCTOR CORP. ]
